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參數(shù)資料
| 型號： | SAA1575HL |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Global Positioning System (GPS)baseband processor(通用定位系統(tǒng)基帶處理器) |
| 中文描述： | SPECIALTY TELECOM CIRCUIT, PQFP100 |
| 封裝： | 14 X 14 MM, 1.40 MM HEIGHT, PLASTIC, SOT-407-1, LQFP-100 |
| 文件頁數(shù)： | 31/56頁 |
| 文件大?。?/td> | 744K |
| 代理商： | SAA1575HL |
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1999 Jun 04
31
Philips Semiconductors
Product specification
Global Positioning System (GPS)
baseband processor
SAA1575HL
Notes
1.
2.
For default DCMS operation.
The 1 s pulse output is only valid when at least one channel is locked.
Table 4
Explanation of symbol characters in Chapter “AC characteristics”
External data memory write;
see Fig.19
t
AVAU
t
WLDL
t
W(DMCS)
t
WHDH
address valid time
WRH and WRL asserted to DMCS asserted
DMCS pulse width
WRH and WRL de-asserted to DMCS
de-asserted
address valid to WRH and WRL asserted
WRH and WRL pulse width
address valid to data valid
data valid to WRH and WRL de-asserted
WRH and WRL de-asserted to address
undefined
data hold time after WRH and WRL
de-asserted
164.7
65.7
2.0
2.0
4.0
4.0
ns
ns
ns
ns
note 1
t
AVWL
t
WLWH
t
AVQV
t
QVWL
t
WHAU
63.7
64.7
67.7
9.0
2.0
65.7
4.0
ns
ns
ns
ns
ns
t
h(D)
0
1.0
ns
GPS IF input timing;
see Fig.20
t
FVSH
t
SHFV
IF set-up time before rising edge of SCLK
IF hold time after rising edge of SCLK
0
10
ns
ns
1 second pulse output;
see Fig.21
t
W(T1S)
T
T1S
T1S pulse width
T1S pulse period
1.0
1.0
μ
s
s
note 2
SYMBOL CHARACTER
DESCRIPTION
A
C
D
E
I
P
Q
R
W
H
L
U
V
Z
address
clock
input data
DMCS strobe
instruction (program memory)
PCMS strobe
output data
RD
WRH or WRL strobes
logic high
logic low
undefined
valid
high impedance or pull-up
SYMBOL
PARAMETER
CONDITIONS
MIN.
TYP.
MAX.
UNIT
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| SAA16M8YX6XV4TL | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DOUBLE DATA RATE (DDR) SDRAM |
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