參數(shù)資料
型號： S9S08DZ128F2CLH
廠商： Freescale Semiconductor
文件頁數(shù)： 197/458頁
文件大小： 0K
描述： MCU 128K FLASH AUTO 64-LQFP
標準包裝： 160
系列： S08
核心處理器： S08
芯體尺寸： 8-位
速度： 40MHz
連通性： CAN，I²C，LIN，SCI，SPI
外圍設(shè)備： LVD，POR，PWM，WDT
輸入/輸出數(shù)： 53
程序存儲器容量： 128KB（128K x 8）
程序存儲器類型： 閃存
EEPROM 大?。?/td> 2K x 8
RAM 容量： 8K x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 24x12b
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 64-LQFP
包裝： 托盤
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Chapter 12 Freescale’s Controller Area Network (S08MSCANV1)
MC9S08DZ128 Series Data Sheet, Rev. 1
276
Freescale Semiconductor
Figure 12-23 shows the common 13-byte data structure of receive and transmit buffers for extended
identiers. The mapping of standard identiers into the IDR registers is shown in Figure 12-24.
All bits of the receive and transmit buffers are ‘x’ out of reset because of RAM-based implementation1.
All reserved or unused bits of the receive and transmit buffers always read ‘x’.
Table 12-24. Message Buffer Organization
Offset
Address
Register
Access
0x00X0
Identier Register 0
0x00X1
Identier Register 1
0x00X2
Identier Register 2
0x00X3
Identier Register 3
0x00X4
Data Segment Register 0
0x00X5
Data Segment Register 1
0x00X6
Data Segment Register 2
0x00X7
Data Segment Register 3
0x00X8
Data Segment Register 4
0x00X9
Data Segment Register 5
0x00XA
Data Segment Register 6
0x00XB
Data Segment Register 7
0x00XC
Data Length Register
0x00XD
Transmit Buffer Priority Register1
1 Not applicable for receive buffers
0x00XE
Time Stamp Register (High Byte)2
2 Read-only for CPU
0x00XF
Time Stamp Register (Low Byte)3
3 Read-only for CPU
1. Exception: The transmit priority registers are 0 out of reset.
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PDF描述
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S9S08DZ128F2MLL 功能描述:8位微控制器 -MCU 8 BIT 128K FLS/2K EEPROM RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
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