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參數資料
| 型號： | S71GL064A08BFI0B3 |
| 廠商： | SPANSION LLC |
| 元件分類： | 存儲器 |
| 英文描述： | Stacked Multi-Chip Product (MCP) Flash Memory and RAM |
| 中文描述： | SPECIALTY MEMORY CIRCUIT, PBGA56 |
| 封裝： | 7 X 9 MM, 1.20 MM HEIGHT, LEAD FREE, FBGA-56 |
| 文件頁數： | 4/134頁 |
| 文件大小： | 2383K |
| 代理商： | S71GL064A08BFI0B3 |
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February 8, 2005 S71GL064A_00_A2
S71GL064A based MCPs
99
Advance
Informatio n
Notes:
1. Minimum cycle time for writing register is equal to speed grade of product.
Figure 35. Deep Sleep Mode - Entry/Exit Timings (for 64M)
Figure 36. Deep Sleep Mode - Entry/Exit Timings (for 32M and 16M)
Table 24. Mode Register Update and Deep Sleep Timings
Item
Symbol
Min
Max
Unit
Note
Chip deselect to ZZ# low
tCDZZ
5
ns
ZZ# low to WE# low
tZZWE
10
500
ns
Write register cycle time
tWC
70/85
ns
1
Chip enable to end of write
tCW
70/85
ns
1
Address valid to end of write
tAW
70/85
ns
1
Write recovery time
tWR
0
ns
Address setup time
tAS
0
ns
Write pulse width
tWR
40
ns
Deep Sleep Pulse Width
tZZMIN
10
s
Deep Sleep Recovery
tR
200
s
Table 25. Address Patterns for PASR (A4=1) (64M)
A2 A1 A0
Active Section
Address Space
Size
Density
1
Top quarter of die
300000h-3FFFFFh
1Mb x 16
16Mb
1
0
Top half of die
200000h-3FFFFFh
2Mb x 16
32Mb
1
0
1
Reserved
ZZ#
tZZMIN
tCDZZ
tR
CE#
A4
ZZ#
tWC
tBW
tAS
CE#
WE#
tZZWE
tAW
tWP
tWR
tR
tZZMIN
LB#, UB#
相關PDF資料 |
PDF描述 |
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| S71GL064A08BFW0B3 | Stacked Multi-Chip Product (MCP) Flash Memory and RAM |
| S71GL064A08BFW0F3 | Stacked Multi-Chip Product (MCP) Flash Memory and RAM |
| S71GL064A08 | STACKED MULTI CHIP PRODUCT FLASH MEMORY AND RAM |
相關代理商/技術參數 |
參數描述 |
|---|---|
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| S71GL064A08BFW0B2 | 制造商:SPANSION 制造商全稱:SPANSION 功能描述:Stacked Multi-Chip Product (MCP) Flash Memory and RAM |
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