參數(shù)資料
型號： S3P863A-AQ
元件分類： 微控制器/微處理器
英文描述： 8-BIT, OTPROM, 12 MHz, MICROCONTROLLER, PDIP42
封裝： SDIP-42
文件頁數(shù)： 209/397頁
文件大?。?/td> 1373K
代理商： S3P863A-AQ
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SYNC PROCESSOR
S3C8639/C863A/P863A/C8647/F8647
16-18
HBLKEN
equ
6
;Hsync Blanking Enable(0:Bypass, 1:Blanking)
VOSS
equ
5
;VsyncO source selection(0:VsyncI, 1:5-bit compare out)
;
;// SYNCON1
CLMP1
equ
7
;
CLMP0
equ
6
;ClampO pulse width
FBPS
equ
5
;Front/Back porch selection(0:back, 1:front)
CLMPS
equ
4
;ClampO polarity control(0:negative, 1:positive)
VOS
equ
3
;VsyncO polarity control(0:by-pass, 1:invert)
HOS
equ
2
;HsyncO polarity control(0:by-pass, 1:invert)
VPOL
equ
1
;Vsync polarity detection(0:negative, 1:positive)
;Read only
HPOL
equ
0
;Hsync polarity detection(0:negative, 1:positive)
;Read only
;
;// SYNCON2
UNMIXHSYNC
equ
7
;Unmixed Hsync detection
;(0:Mixed sync, 1:Unmixed sync), Read only
CCSS
equ
5
;5-bit counter clock selection(0:fosc/2, 1:fosc/3)
PSGEN
equ
4
;Pseudo Sync Generation Disable
SYNOD
equ
3
;Sync Signal Output Diasble
SOGI
equ
2
;SOG check
UP5BSDET
equ
1
;5-Bit Up/Down Counter Status Changing Det.
VDDLS
equ
0
;VDD Level Selection(0:VDD=5V,1:VDD=3V)
;
;// Watch-dog(Basic) Timer
BTCLR
equ
1
;
;// Timer M0
T0EDGSEL
equ
4
;Timer M0 Capture Mode Selection
T0CLR
equ
3
;Counter clear
T0OVINT
equ
2
;Overflow interrupt enable
T0INT
equ
1
;Capture enable
T0CAPSEL
equ
0
;Capture input selection
;(0:External pin, 1:Vsync from sync-processor)
;
;// Timer M1
T1CAPSEL
equ
7
;Capture signal source selection
;(0:Timer2, 1:VsyncO from P)
VEDGSEL
equ
6
;VsyncO capture edge selection(0:rising, 1:falling)
T1CAPEN
equ
5
;Capture interrupt enable
T1PND
equ
4
;Capture interrupt pending flag
T1CLR
equ
3
;Counter clear
T1OVFINT
equ
2
;Overflow interrupt enable
;
;// Timer M2
T2INT
equ
2
CAPINTV1
equ
1
CAPINTV0
equ
0
;
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PDF描述
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