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參數(shù)資料
| 型號(hào)： | S3C8285XXX-QW |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 11.1 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | 14 X 20 MM, QFP-80 |
| 文件頁(yè)數(shù)： | 154/369頁(yè) |
| 文件大?。?/td> | 3010K |
| 代理商： | S3C8285XXX-QW |
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S3C828B/F828B/C8289/F8289/C8285/F8285
RESET and POWER-DOWN
8-1
8
RESET and POWER-DOWN
SYSTEM RESET
OVERVIEW
During a power-on reset, the voltage at VDD goes to High level and the RESET pin is forced to Low level. The
RESET signal is input through a schmitt trigger circuit where it is then synchronized with the CPU clock. This
procedure brings the S3C828B/F828B/C8289/F8289/C8285/F8285 into a known operating status.
To allow time for internal CPU clock oscillation to stabilize, the RESET pin must be held to Low level for a
minimum time interval after the power supply comes within tolerance. The minimum required time of a reset
operation for oscillation stabilization is 1 millisecond.
Whenever a reset occurs during normal operation (that is, when both VDD and RESET are High level), the
nRESET pin is forced Low level and the reset operation starts. All system and peripheral control registers are
then reset to their default hardware values
In summary, the following sequence of events occurs during a reset operation:
— All interrupt is disabled.
— The watchdog function (basic timer) is enabled.
— Ports 0-8 and set to input mode, and all pull-up resistors are disabled for the I/O port.
— Peripheral control and data register settings are disabled and reset to their default hardware values.
— The program counter (PC) is loaded with the program reset address in the ROM, 0100H.
— When the programmed oscillation stabilization time interval has elapsed, the instruction stored in ROM
location 0100H (and 0101H) is fetched and executed at normal mode by smart option.
— The reset address at ROM can be changed by Smart Option in the S3F828B (full-flash device). Refer to "The
Chapter 19. Embedded Flash Memory Interface" for more detailed contents.
NORMAL MODE RESET OPERATION
In normal (masked ROM) mode, the Test pin is tied to VSS. A reset enables access to the S3C828B (64Kbyte),
S3C8289 (32-Kbyte), and S3C8285 (16-Kbyte) on-chip ROM. (The external interface is not automatically
configured).
NOTE
To program the duration of the oscillation stabilization interval, you make the appropriate settings to the
basic timer control register, BTCON, before entering Stop mode. Also, if you do not want to use the basic
timer watchdog function (which causes a system reset if a basic timer counter overflow occurs), you can
disable it by writing "1010B" to the upper nibble of BTCON.
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