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參數(shù)資料
| 型號(hào)： | S1C62480D |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 4-BIT, MROM, 2.3 MHz, MICROCONTROLLER, UUC135 |
| 封裝： | 6.65 X 5.68 MM, DIE-135 |
| 文件頁(yè)數(shù)： | 12/345頁(yè) |
| 文件大小： | 2185K |
| 代理商： | S1C62480D |
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S1C62440/624A0/624C0/62480 TECHNICAL HARDWARE
EPSON
I-95
CHAPTER 10: TIME BASE COUNTER
(1) When the clock timer has been reset, the interrupt factor
flag (IT) may sometimes be set to "1". Consequently,
perform flag read (reset the flag) as necessary at reset.
(2) Because the watchdog timer counts up during reset as in
the above (1), reset the watchdog timer as necessary.
(3) When the low-order digits (TM0–TM3) and high-order
digits (TM4–TM7) are consecutively read, proper reading
may not be obtained due to the carry from the low-order
digits into the high-order digits (when the reading of the
low-order digits and high-order digits span the timing of
the carry). For this reason, perform multiple reading of
timer data, make comparisons and use matching data as
result.
(4) Be sure that writing to the interrupt mask register is
done with the interrupt in the DISABLE state (DI). Writ-
ing to the interrupt mask register while in the ENABLE
state (EI) may cause malfunction.
(5) Be sure that the interrupt factor flag reading is done with
the interrupt in the DISABLE state (DI). Reading the
interrupt factor flag while in the ENABLE state (EI) may
cause malfunction.
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