參數(shù)資料
型號： R5F56216BDLD#U0
廠商： Renesas Electronics America
文件頁數(shù)： 21/148頁
文件大?。?/td> 0K
描述： MCU 32BIT FLASH 256KROM 85TFLGA
產(chǎn)品培訓(xùn)模塊： RX Compare Match Timer
RX DMAC
標(biāo)準(zhǔn)包裝： 1
系列： RX600
核心處理器： RX
芯體尺寸： 32-位
速度： 100MHz
連通性： CAN，EBI/EMI，I²C，SCI，SPI，USB
外圍設(shè)備： DMA，LVD，POR，PWM，WDT
輸入/輸出數(shù)： 58
程序存儲器容量： 256KB（256K x 8）
程序存儲器類型： 閃存
RAM 容量： 64K x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10/12b，D/A 1x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 85-TFLGA
包裝： 托盤
2004 Microchip Technology Inc.
DS39609B-page 115
PIC18F6520/8520/6620/8620/6720/8720
FIGURE 10-11:
PORTE BLOCK DIAGRAM IN I/O MODE
FIGURE 10-12:
PORTE BLOCK DIAGRAM IN SYSTEM BUS MODE
Peripheral Out Select
Data Bus
WR LATE
WR TRISE
Data Latch
TRIS Latch
RD TRISE
Q
D
Q
CK
QD
EN
Peripheral Data Out
0
1
Q
D
Q
CK
P
N
VDD
VSS
RD PORTE
Peripheral Data In
I/O pin(1)
or WR PORTE
RD LATE
Schmitt
Trigger
Note 1: I/O pins have diode protection to VDD and VSS.
TRIS
Override
Peripheral Enable
TRIS OVERRIDE
Pin
Override
Peripheral
RE0
Yes
External Bus
RE1
Yes
External Bus
RE2
Yes
External Bus
RE3
Yes
External Bus
RE4
Yes
External Bus
RE5
Yes
External Bus
RE6
Yes
External Bus
RE7
Yes
External Bus
Instruction Register
Bus Enable
Data/TRIS Out
Drive Bus
System Bus
Control
Data Bus
WR LATE
WR TRISE
RD PORTE
Data Latch
TRIS Latch
RD TRISE
TTL
Input
Buffer
I/O pin(1)
Q
D
CK
Q
D
CK
EN
QD
EN
RD LATE
or PORTE
0
1
Port
Data
Instruction Read
Note 1: I/O pins have protection diodes to VDD and VSS.
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PDF描述
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參數(shù)描述
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