參數(shù)資料
      型號: PSD835G2-A-70J
      廠商: 意法半導(dǎo)體
      英文描述: Configurable Memory System on a Chip for 8-Bit Microcontrollers
      中文描述: 在8片位微控制器可配置存儲系統(tǒng)
      文件頁數(shù): 33/110頁
      文件大小: 570K
      代理商: PSD835G2-A-70J
      PSD8XX Family
      PSD835G2
      32
      The
      PSD835G2
      Functional
      Blocks
      (cont.)
      9.1.5 Memory ID Registers
      The 8-bit read only memory status registers are included in the CSIOP space. The user
      can determine the memory configuration of the PSD device by reading the Memory ID0
      and Memory ID1 registers. The content of the registers are defined as follow:
      Bit 7
      Bit 6
      Bit 5
      Bit 4
      Bit 3
      Bit 2
      Bit 1
      Bit 0
      S_size 3
      S_size 2
      S_size 1
      S_size 0
      F_size 3
      F_size 2
      F_size 1
      F_size 0
      Memory_ID0 Register
      Main Flash Size
      (Bit)
      none
      256K
      512K
      1M
      2M
      4M
      8M
      F_size3
      0
      0
      0
      0
      0
      0
      0
      F_size2
      0
      0
      0
      0
      1
      1
      1
      F_size1
      0
      0
      1
      1
      0
      0
      1
      F_size0
      0
      1
      0
      1
      0
      1
      0
      Bit Definition
      SRAM Size
      (Bit)
      none
      16K
      32K
      64K
      S_size3
      0
      0
      0
      0
      S_size2
      0
      0
      0
      0
      S_size1
      0
      0
      1
      1
      S_size0
      0
      1
      0
      1
      Bit 7
      Bit 6
      Bit 5
      Bit 4
      Bit 3
      Bit 2
      Bit 1
      Bit 0
      *
      *
      B_type 1
      B_type 0
      B_size 3
      B_size 2
      B_size 1
      B_size 0
      Memory_ID1 Register
      *
      Not used bit should be set to zero.
      Boot Block Size
      (Bit)
      none
      128K
      256K
      512K
      B_size3
      0
      0
      0
      0
      B_size2
      0
      0
      0
      0
      B_size1
      0
      0
      1
      1
      B_size0
      0
      1
      0
      1
      Bit Definition
      B_type1
      0
      0
      B_type0
      0
      1
      Boot Block Type
      Flash
      EEPROM
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      PDF描述
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      PSD835G2-A-70MI Configurable Memory System on a Chip for 8-Bit Microcontrollers
      PSD835G2-A-70U Configurable Memory System on a Chip for 8-Bit Microcontrollers
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      參數(shù)描述
      PSD835G2V-12UI 功能描述:靜態(tài)隨機存取存儲器 3.0V 4M 120ns RoHS:否 制造商:Cypress Semiconductor 存儲容量:16 Mbit 組織:1 M x 16 訪問時間:55 ns 電源電壓-最大:3.6 V 電源電壓-最小:2.2 V 最大工作電流:22 uA 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:TSOP-48 封裝:Tray
      PSD835G2V-90U 功能描述:靜態(tài)隨機存取存儲器 3.0V 4M 90ns RoHS:否 制造商:Cypress Semiconductor 存儲容量:16 Mbit 組織:1 M x 16 訪問時間:55 ns 電源電壓-最大:3.6 V 電源電壓-最小:2.2 V 最大工作電流:22 uA 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:TSOP-48 封裝:Tray
      PSD853F2-70J 功能描述:SPLD - 簡單可編程邏輯器件 5.0V 1M 70ns RoHS:否 制造商:Texas Instruments 邏輯系列:TICPAL22V10Z 大電池數(shù)量:10 最大工作頻率:66 MHz 延遲時間:25 ns 工作電源電壓:4.75 V to 5.25 V 電源電流:100 uA 最大工作溫度:+ 75 C 最小工作溫度:0 C 安裝風(fēng)格:Through Hole 封裝 / 箱體:DIP-24
      PSD853F2-70M 功能描述:CPLD - 復(fù)雜可編程邏輯器件 5.0V 1M 70ns RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
      PSD853F2-90J 功能描述:CPLD - 復(fù)雜可編程邏輯器件 5.0V 1M 90ns RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100