參數(shù)資料
型號： PSD4235F2-C-70B81
廠商： 意法半導(dǎo)體
英文描述： Flash In-System-Programmable Peripherals for 16-Bit MCUs
中文描述： Flash在系統(tǒng)可編程外設(shè)的16位微控制器
文件頁數(shù)： 73/89頁
文件大小： 703K
代理商： PSD4235F2-C-70B81
73/89
PSD4235G2
Table 63. CPLD Macrocell Asynchronous Clock Mode Timing
Symbol
Parameter
Conditions
-70
-90
PT
Aloc
Turbo
Off
Slew
Rate
Unit
Min
Max
Min
Max
f
MAXA
Maximum
Frequency
External
Feedback
1/(t
SA
+t
COA
)
38.4
26.32
MHz
Maximum
Frequency
Internal
Feedback
(f
CNTA
)
1/(t
SA
+t
COA
–10)
62.5
35.71
MHz
Maximum
Frequency
Pipelined Data
1/(t
CHA
+t
CLA
)
47.6
37.03
MHz
t
SA
Input Setup
Time
6
8
+ 2
+ 12
ns
t
HA
Input Hold Time
7
12
ns
t
CHA
Clock Input
High Time
9
12
+ 12
ns
t
CLA
Clock Input Low
Time
12
15
+ 12
ns
t
COA
Clock to Output
Delay
21
30
+ 12
– 2
ns
t
ARDA
CPLD Array
Delay
Any Macrocell
11
16
+ 2
ns
t
MINA
Minimum Clock
Period
1/f
CNTA
16
28
ns
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