參數(shù)資料
型號： PSB4600F
英文描述： 1 Form A Photo Voltaic Isolator in a mod. 8-pin DIP Package; Similar to PVI5050N with lead free packagaing.
中文描述： PCI接口的語音和數(shù)據(jù)應(yīng)用。停產(chǎn)
文件頁數(shù)： 42/204頁
文件大?。?/td> 1894K
代理商： PSB4600F
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PSB 4600
Communication with the PITA
Semiconductor Group
4-25
Preliminary Data Sheet 12.98
4.3.1
Information about the Power Management States
________________________________________
Description
The PITA supports the Power Management states D0, D1, D2, D3, D3
hot
and
D3
cold
.
________________________________________
D0
The D0 state represents the default state of the internal logic after a system
reset.
After a system reset the PCI interface is in the D0 state and has to be initialized
before being used.
The PITA responds only to configuration accesses while not completely
initialized.
The PCI Master Target controller is disabled while not completely initialized.
________________________________________
D1
D1 is a light sleep rate.
The PITA supports the D1 state by default if this state is not disabled by an
EEPROM configuration.
The PITA PCI function can be set to the D1 state by software.
The PITA PCI function only responds to PCI configuration accesses.
All accesses to the memory spaces defined by the Base Address Registers are
disabled.
The only PCI bus operation the PCI interface is allowed to initiate is the
assertion of the PME signal.
________________________________________
D2
By default the support of the D2 state is disabled in the PITA.
D2 can be enabled by configuration by an EEPROM.
Same state behavior as described for the state D1.
________________________________________
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