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參數(shù)資料
| 型號(hào)： | PLSI1024-50LJ |
| 英文描述： | Electrically-Erasable Complex PLD |
| 中文描述： | 電可擦除復(fù)雜可編程邏輯器件 |
| 文件頁(yè)數(shù)： | 1/18頁(yè) |
| 文件大?。?/td> | 1146K |
| 代理商： | PLSI1024-50LJ |
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相關(guān)PDF資料 |
PDF描述 |
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| PLSI1024-60LJ | Parallel 16-Bit Rail-to-Rail Micropower DAC; Package: SSOP; No of Pins: 28; Temperature Range: 0°C to +70°C |
| ISTS822S | |
| ISTS822SD | |
| ISTS832S | |
| ISTS832SD | |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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