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    參數(shù)資料
    

    


    


    
型號：
PIC18LF8585-I/PT

    

    
廠商：
Microchip Technology

    

    
文件頁數(shù)：
51/424頁

    

    
文件大?。?/td>
0K

    

    
描述：
IC PIC MCU FLASH 24KX16 80TQFP

    

    
產(chǎn)品培訓(xùn)模塊：
Asynchronous Stimulus
    
	8-bit PIC® Microcontroller Portfolio
    		

    

    
標(biāo)準(zhǔn)包裝：
119

    

    
系列：
PIC® 18F

    

    
核心處理器：
PIC
    		

    

    
芯體尺寸：
8-位
    		

    

    
速度：
40MHz
    		

    

    
連通性：
CAN，EBI/EMI，I²C，SPI，UART/USART
    		

    

    
外圍設(shè)備：
欠壓檢測/復(fù)位，LVD，POR，PWM，WDT
    		

    

    
輸入/輸出數(shù)：
68
    		

    

    
程序存儲器容量：
48KB（24K x 16）
    		

    

    
程序存儲器類型：
閃存
    		

    

    
EEPROM 大?。?/td>
1K x 8
    		

    

    
RAM 容量：
3.25K x 8
    		

    

    
電壓 - 電源 (Vcc/Vdd)：
2 V ~ 5.5 V
    		

    

    
數(shù)據(jù)轉(zhuǎn)換器：
A/D 12x10b
    		

    

    
振蕩器型：
外部
    		

    

    
工作溫度：
-40°C ~ 85°C
    		

    

    
封裝/外殼：
80-TQFP
    		

    

    
包裝：
托盤
    		

    

    
產(chǎn)品目錄頁面：
646 (CN2011-ZH PDF)
    		

    

    
其它名稱：
PIC18LF8585-I/PTR
    PIC18LF8585-I/PTR-ND
    		

    

    

    

	
    
    
    
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    PIC18F6585/8585/6680/8680
    DS30491C-page 142
     2004 Microchip Technology Inc.
    10.7
    PORTG, TRISG and LATG
    Registers
    PORTG is a 6-bit wide port with 5 bidirectional pins and
    1 unidirectional pin. The corresponding data direction
    register is TRISG. Setting a TRISG bit (= 1) will make
    the corresponding PORTG pin an input (i.e., put the
    corresponding output driver in a high-impedance
    mode). Clearing a TRISG bit (= 0) will make the corre-
    sponding PORTG pin an output (i.e., put the contents
    of the output latch on the selected pin).
    The Data Latch register (LATG) is also memory mapped.
    Read-modify-write operations on the LATG register read
    and write the latched output value for PORTG.
    Pins RG0-RG2 on PORTG are multiplexed with the CAN
    peripheral. Refer to Section 23.0 “ECAN Module” for
    proper settings of TRISG when CAN is enabled. RG5 is
    multiplexed with MCLR/VPP. Refer to Register 24-5 for
    more information.
    When enabling peripheral functions, care should be
    taken in defining TRIS bits for each PORTG pin. Some
    peripherals override the TRIS bit to make a pin an output,
    while other peripherals override the TRIS bit to make a
    pin an input. The user should refer to the corresponding
    peripheral section for the correct TRIS bit settings.
    The pin override value is not loaded into the TRIS reg-
    ister. This allows read-modify-write of the TRIS register
    without concern due to peripheral overrides.
    EXAMPLE 10-7:
    INITIALIZING PORT
    FIGURE 10-16:
    RG0/CANTX1 PIN BLOCK DIAGRAM
    Note:
    On a Power-on Reset, these pins are
    configured as digital inputs.
    Note 1: On a Power-on Reset, RG5 is enabled as
    a digital input only if Master Clear
    functionality is disabled (MCLRE = 0).
    2: If the device Master Clear is disabled,
    verify that either of the following is done to
    ensure proper entry into ICSP mode:
    a) disable Low-Voltage Programming
    (CONFIG4L<2> = 0); or
    b) make certain that RB5/KBI1/PGM is
    held low during entry into ICSP.
    CLRF
    PORTG
    ; Initialize PORTG by
    ; clearing output
    ; data latches
    CLRF
    LATG
    ; Alternate method
    ; to clear output
    ; data latches
    MOVLW
    04h
    ; Value used to
    ; initialize data
    ; direction
    MOVWF
    TRISG
    ; Set RG1:RG0 as outputs
    ; RG2 as input
    ; RG4:RG3 as inputs
    Data Latch
    TRIS Latch
    RD TRISG
    P
    VSS
    Q
    D
    Q
    CK
    Q
    D
    Q
    CK
    EN
    QD
    EN
    N
    VDD
    0
    1
    RD PORTG
    WR TRISG
    Data Bus
    I/O pin
    TXD
    ENDRHI
    OPMODE2:OPMODE0 = 000
    Schmitt
    Trigger
    RD LATG
    WR PORTG or
    WR LATG
    OPMODE2:OPMODE0 = 000
    Note: I/O pins have diode protection to VDD and VSS.
    
    
    
    
    
    


    


    

    相關(guān)PDF資料
    		

    PDF描述
    		

    
    

    
PIC32MX675F512L-80V/PT
IC MCU 32BIT 512KB FLASH 100TQFP

    

    
PIC32MX695F512H-80V/PT
IC MCU 32BIT 512KB FLASH 121XBGA

    

    
C8051F007
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PIC24EP512GU814-I/PH
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    相關(guān)代理商/技術(shù)參數(shù)
    		

    參數(shù)描述
    		

    
    

    
PIC18LF8585T-I/PT
功能描述:8位微控制器 -MCU 48KB 3328 RAM 68I/O RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT

    

    
PIC18LF8620-I/PT
功能描述:8位微控制器 -MCU 64KB 3840 RAM 68I/O RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT

    

    
PIC18LF8620-I/PT
 制造商:Microchip Technology Inc 功能描述:8BIT FLASH MCU 18LF8620 TQFP80

    

    
PIC18LF8620-I/PTC01
 制造商:Microchip Technology Inc 功能描述:

    

    
PIC18LF8620T-I/PT
功能描述:8位微控制器 -MCU 64KB 3840 RAM 68I/O RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT

    

    
    
    
    
	
    	
    
    
     
     
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                                    *數(shù)量
                                    廠商
                                    批號
                                    封裝
                                  
    
                                    
                                
                                
    
                                    
                                        
    
                                            
                                            
                                        
    
                                        		
                                     
                                    
                                        
    
                                        		
                                    
                                        
    
                                        		
                                    
                                        
    
                                        		
                                    
                                        
    
                                        		
                                  
    
                                  
                                   
                                    
                            
    
                             
                             
							                            
    
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    我的聯(lián)系方式
    
                     
                     
                       
    
                                
                                
                                
    
                                    
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