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參數(shù)資料
| 型號： | PIC18LC658T-I/L |
| 廠商： | Microchip Technology |
| 文件頁數(shù)： | 242/246頁 |
| 文件大小： | 0K |
| 描述： | IC MCU OTP 16KX16 CAN 68PLCC |
| 標(biāo)準(zhǔn)包裝： | 300 |
| 系列： | PIC® 18C |
| 核心處理器： | PIC |
| 芯體尺寸： | 8-位 |
| 速度： | 40MHz |
| 連通性： | CAN，I²C，SPI，UART/USART |
| 外圍設(shè)備： | 欠壓檢測/復(fù)位，LVD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 52 |
| 程序存儲器容量： | 32KB（16K x 16） |
| 程序存儲器類型： | OTP |
| RAM 容量： | 1.5K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.5 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 12x10b |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 68-LCC（J 形引線） |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | PIC18LC658TI/L |
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2000 Microchip Technology Inc.
Advanced Information
DS30475A-page 95
PIC18CXX8
8.4
PORTD, TRISD and LATD Registers
PORTD is an 8-bit wide, bi-directional port. The corre-
sponding Data Direction register is TRISD. Setting a
TRISD bit (=1) will make the corresponding PORTD pin
an input (i.e., put the corresponding output driver in a
hi-impedance mode). Clearing a TRISD bit (=0) will
make the corresponding PORTD pin an output (i.e., put
the contents of the output latch on the selected pin).
Read-modify-write operations on the LATD register
reads and writes the latched output value for PORTD.
PORTD is an 8-bit port with Schmitt Trigger input buff-
ers. Each pin is individually configurable as an input or
output.
PORTD can be configured as an 8-bit wide micro-
processor port (parallel slave port), by setting control
bit PSPMODE (PSPCON register). In this mode, the
input buffers are TTL. See Section 9.0 for additional
information on the Parallel Slave Port (PSP).
EXAMPLE 8-4:
INITIALIZING PORTD
FIGURE 8-7:
PORTD BLOCK DIAGRAM
IN I/O PORT MODE
CLRF
PORTD
; Initialize PORTD by
; clearing output
; data latches
CLRF
LATD
; Alternate method
; to clear output
; data latches
MOVLW
0xCF
; Value used to
; initialize data
; direction
MOVWF
TRISD
; Set RD3:RD0 as inputs
; RD5:RD4 as outputs
; RD7:RD6 as inputs
Data
Bus
WR LATD
WR TRISD
RD PORTD
Data Latch
TRIS Latch
RD TRISD
Schmitt
Trigger
Input
Buffer
I/O Pin
Note: I/O pins have diode protection to VDD and VSS.
Q
D
CK
Q
D
CK
EN
QD
EN
RD LATD
or
WR PORTD
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