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參數(shù)資料
| 型號(hào)： | PIC18C858T-I/L |
| 廠商： | Microchip Technology |
| 文件頁數(shù)： | 12/246頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU OTP 16KX16 CAN 84PLCC |
| 標(biāo)準(zhǔn)包裝： | 300 |
| 系列： | PIC® 18C |
| 核心處理器： | PIC |
| 芯體尺寸： | 8-位 |
| 速度： | 40MHz |
| 連通性： | CAN，I²C，SPI，UART/USART |
| 外圍設(shè)備： | 欠壓檢測/復(fù)位，LVD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 68 |
| 程序存儲(chǔ)器容量： | 32KB（16K x 16） |
| 程序存儲(chǔ)器類型： | OTP |
| RAM 容量： | 1.5K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 4.2 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 16x10b |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 84-LCC（J 形引線） |
| 包裝： | 帶卷 (TR) |
| 配用： | AC164310-ND - MODULE SKT FOR PM3 84PLCC DVA18XL840-ND - ADAPTER DEVICE ICE 84PLCC AC174012-ND - MODULE SKT PROMATEII 84PLCC |
| 其它名稱： | PIC18C858TI/L |
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2000 Microchip Technology Inc.
Advanced Information
DS30475A-page 109
PIC18CXX8
9.0
PARALLEL SLAVE PORT
The Parallel Slave Port is an 8-bit parallel interface for
transferring data between the PIC18CXX8 device and
an external device.
PORTD operates as an 8-bit wide Parallel Slave Port,
or microprocessor port when control bit PSPMODE
(PSPCON register) is set. In Slave mode, it is asyn-
chronously readable and writable by the external world
through RD control input pin RE0/RD and WR control
input pin RE1/WR.
It can directly interface to an 8-bit microprocessor data
bus. The external microprocessor can read or write the
PORTD latch as an 8-bit latch. Setting bit PSPMODE
enables port pin RE0/RD to be the RD input, RE1/WR
to be the WR input and RE2/CS to be the CS (chip
select) input. For this functionality, the corresponding
data direction bits of the TRISE register (TRISE<2:0>)
must be configured as inputs (set).
A write to the PSP occurs when both the CS and WR
lines are first detected low. A read from the PSP occurs
when both the CS and RD lines are first detected low.
The PORTE I/O pins become control inputs for the
microprocessor port when bit PSPMODE (PSPCON
Register) is set. In this mode, the user must make sure
that the TRISE<2:0> bits are set (pins are configured
as digital inputs). In this mode, the input buffers are
TTL.
FIGURE 9-1:
PORTD AND PORTE BLOCK
DIAGRAM
(PARALLEL SLAVE PORT)
Data Bus
WR LATD
RDx Pin
Q
D
CK
EN
QD
EN
RD PORTD
One bit of PORTD
Set Interrupt Flag
PSPIF (PIR1<7>)
Read
Chip Select
Write
RD
CS
WR
TTL
or
WR PORTD
RD LATD
Data Latch
Note:
I/O pins have diode protection to VDD and VSS.
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