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    參數(shù)資料
    型號： PIC16LF747-I/ML
    廠商： Microchip Technology
    文件頁數(shù)： 109/231頁
    文件大小： 0K
    描述： IC PIC MCU FLASH 4KX14 44QFN
    產(chǎn)品培訓(xùn)模塊： Asynchronous Stimulus
    標準包裝： 45
    系列： PIC® 16F
    核心處理器： PIC
    芯體尺寸： 8-位
    速度： 10MHz
    連通性： I²C，SPI，UART/USART
    外圍設(shè)備： 欠壓檢測/復(fù)位，POR，PWM，WDT
    輸入/輸出數(shù)： 36
    程序存儲器容量： 7KB（4K x 14）
    程序存儲器類型： 閃存
    RAM 容量： 368 x 8
    電壓 - 電源 (Vcc/Vdd)： 2 V ~ 5.5 V
    數(shù)據(jù)轉(zhuǎn)換器： A/D 14x10b
    振蕩器型： 內(nèi)部
    工作溫度： -40°C ~ 85°C
    封裝/外殼： 44-VQFN 裸露焊盤
    包裝： 管件
    第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁當前第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁
    PIC16F7X7
    DS30498C-page 18
    2004 Microchip Technology Inc.
    2.2.2
    SPECIAL FUNCTION REGISTERS
    The Special Function Registers are registers used by
    the CPU and peripheral modules for controlling the
    desired operation of the device. These registers are
    implemented as static RAM. A list of these registers is
    given in Table 2-1.
    The Special Function Registers can be classified into
    two sets: core (CPU) and peripheral. Those registers
    associated with the core functions are described in
    detail in this section. Those related to the operation of
    the peripheral features are described in detail in the
    peripheral feature section.
    TABLE 2-1:
    SPECIAL FUNCTION REGISTER SUMMARY
    Address
    Name
    Bit 7
    Bit 6
    Bit 5
    Bit 4
    Bit 3
    Bit 2
    Bit 1
    Bit 0
    Value on:
    POR, BOR
    Details
    on page
    Bank 0
    00h(4)
    INDF
    Addressing this location uses contents of FSR to address data memory (not a physical register) 0000 0000
    01h
    TMR0
    Timer0 Module Register
    xxxx xxxx
    02h(4)
    PCL
    Program Counter (PC) Least Significant Byte
    0000 0000
    03h(4)
    STATUS
    IRP
    RP1
    RP0
    TO
    PD
    ZDC
    C
    0001 1xxx
    04h(4)
    FSR
    Indirect Data Memory Address Pointer
    xxxx xxxx
    05h
    PORTA
    PORTA Data Latch when written: PORTA pins when read
    xx0x 0000
    06h
    PORTB
    PORTB Data Latch when written: PORTB pins when read
    xx00 0000
    07h
    PORTC
    PORTC Data Latch when written: PORTC pins when read
    xxxx xxxx
    08h(5)
    PORTD
    PORTD Data Latch when written: PORTD pins when read
    xxxx xxxx
    09h(5)
    PORTE
    —
    RE3
    RE2
    RE1
    RE0
    ---- x000
    0Ah(1,4)
    PCLATH
    —
    Write Buffer for the upper 5 bits of the Program Counter
    ---0 0000
    0Bh(4)
    INTCON
    GIE
    PEIE
    TMR0IE
    INT0IE
    RBIE
    TMR0IF
    INT0IF
    RBIF
    0000 000x
    0Ch
    PIR1
    PSPIF(3)
    ADIF
    RCIF
    TXIF
    SSPIF
    CCP1IF
    TMR2IF
    TMR1IF
    0000 0000
    0Dh
    PIR2
    OSFIF
    CMIF
    LVDIF
    —BCLIF
    —
    CCP3IF
    CCP2IF
    000- 0-00
    0Eh
    TMR1L
    Holding Register for the Least Significant Byte of the 16-bit TMR1 Register
    xxxx xxxx
    0Fh
    TMR1H
    Holding Register for the Most Significant Byte of the 16-bit TMR1 Register
    xxxx xxxx
    10h
    T1CON
    —
    T1RUN
    T1CKPS1
    T1CKPS0
    T1OSCEN T1SYNC
    TMR1CS TMR1ON -000 0000
    11h
    TMR2
    Timer2 Module Register
    0000 0000
    12h
    T2CON
    —
    TOUTPS3 TOUTPS2
    TOUTPS1
    TOUTPS0 TMR2ON T2CKPS1 T2CKPS0 -000 0000
    13h
    SSPBUF
    Synchronous Serial Port Receive Buffer/Transmit Register
    xxxx xxxx
    14h
    SSPCON
    WCOL
    SSPOV
    SSPEN
    CKP
    SSPM3
    SSPM2
    SSPM1
    SSPM0
    0000 0000
    15h
    CCPR1L
    Capture/Compare/PWM Register 1 (LSB)
    xxxx xxxx
    16h
    CCPR1H
    Capture/Compare/PWM Register 1 (MSB)
    xxxx xxxx
    17h
    CCP1CON
    —
    CCP1X
    CCP1Y
    CCP1M3
    CCP1M2
    CCP1M1
    CCP1M0 --00 0000
    18h
    RCSTA
    SPEN
    RX9
    SREN
    CREN
    ADDEN
    FERR
    OERR
    RX9D
    0000 000x
    19h
    TXREG
    AUSART Transmit Data Register
    0000 0000
    1Ah
    RCREG
    AUSART Receive Data Register
    0000 0000
    1Bh
    CCPR2L
    Capture/Compare/PWM Register 2 (LSB)
    xxxx xxxx
    1Ch
    CCPR2H
    Capture/Compare/PWM Register 2 (MSB)
    xxxx xxxx
    1Dh
    CCP2CON
    —
    CCP2X
    CCP2Y
    CCP2M3
    CCP2M2
    CCP2M1
    CCP2M0 --00 0000
    1Eh
    ADRESH
    A/D Result Register High Byte
    xxxx xxxx
    1Fh
    ADCON0
    ADCS1
    ADCS0
    CHS2
    CHS1
    CHS0
    GO/DONE
    CHS3
    ADON
    0000 0000
    Legend:
    x
    = unknown, u = unchanged, q = value depends on condition, — = unimplemented, read as ‘0’, r = reserved.
    Shaded locations are unimplemented, read as ‘0’.
    Note 1:
    The upper byte of the program counter is not directly accessible. PCLATH is a holding register for the PC<12:8> bits, whose contents
    are transferred to the upper byte of the program counter during branches (CALL or GOTO).
    2:
    Other (non Power-up) Resets include external Reset through MCLR and Watchdog Timer Reset.
    3:
    Bits PSPIE and PSPIF are reserved on the 28-pin devices; always maintain these bits clear.
    4:
    These registers can be addressed from any bank.
    5:
    PORTD, PORTE, TRISD and TRISE are not physically implemented on the 28-pin devices (except for RE3), read as ‘0’.
    6:
    This bit always reads as a ‘1’.
    7:
    OSCCON<OSTS> bit resets to ‘0’ with dual-speed start-up and LP, HS or HS-PLL selected as the oscillator.
    8:
    RE3 is an input only. The state of the TRISE3 bit has no effect and will always read ‘1’.
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