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  • 參數(shù)資料
    型號(hào)： PIC16LC57CT-04I/SO
    廠商： Microchip Technology
    文件頁(yè)數(shù)： 167/194頁(yè)
    文件大?。?/td> 0K
    描述： IC MCU OTP 2KX12 28SOIC
    標(biāo)準(zhǔn)包裝： 1,600
    系列： PIC® 16C
    核心處理器： PIC
    芯體尺寸： 8-位
    速度： 4MHz
    外圍設(shè)備： POR，WDT
    輸入/輸出數(shù)： 20
    程序存儲(chǔ)器容量： 3KB（2K x 12）
    程序存儲(chǔ)器類型： OTP
    RAM 容量： 72 x 8
    電壓 - 電源 (Vcc/Vdd)： 2.5 V ~ 5.5 V
    振蕩器型： 外部
    工作溫度： -40°C ~ 85°C
    封裝/外殼： 28-SOIC（0.295"，7.50mm 寬）
    包裝： 帶卷 (TR)
    其它名稱： PIC16LC57CT-04ISO
    第1頁(yè)第2頁(yè)第3頁(yè)第4頁(yè)第5頁(yè)第6頁(yè)第7頁(yè)第8頁(yè)第9頁(yè)第10頁(yè)第11頁(yè)第12頁(yè)第13頁(yè)第14頁(yè)第15頁(yè)第16頁(yè)第17頁(yè)第18頁(yè)第19頁(yè)第20頁(yè)第21頁(yè)第22頁(yè)第23頁(yè)第24頁(yè)第25頁(yè)第26頁(yè)第27頁(yè)第28頁(yè)第29頁(yè)第30頁(yè)第31頁(yè)第32頁(yè)第33頁(yè)第34頁(yè)第35頁(yè)第36頁(yè)第37頁(yè)第38頁(yè)第39頁(yè)第40頁(yè)第41頁(yè)第42頁(yè)第43頁(yè)第44頁(yè)第45頁(yè)第46頁(yè)第47頁(yè)第48頁(yè)第49頁(yè)第50頁(yè)第51頁(yè)第52頁(yè)第53頁(yè)第54頁(yè)第55頁(yè)第56頁(yè)第57頁(yè)第58頁(yè)第59頁(yè)第60頁(yè)第61頁(yè)第62頁(yè)第63頁(yè)第64頁(yè)第65頁(yè)第66頁(yè)第67頁(yè)第68頁(yè)第69頁(yè)第70頁(yè)第71頁(yè)第72頁(yè)第73頁(yè)第74頁(yè)第75頁(yè)第76頁(yè)第77頁(yè)第78頁(yè)第79頁(yè)第80頁(yè)第81頁(yè)第82頁(yè)第83頁(yè)第84頁(yè)第85頁(yè)第86頁(yè)第87頁(yè)第88頁(yè)第89頁(yè)第90頁(yè)第91頁(yè)第92頁(yè)第93頁(yè)第94頁(yè)第95頁(yè)第96頁(yè)第97頁(yè)第98頁(yè)第99頁(yè)第100頁(yè)第101頁(yè)第102頁(yè)第103頁(yè)第104頁(yè)第105頁(yè)第106頁(yè)第107頁(yè)第108頁(yè)第109頁(yè)第110頁(yè)第111頁(yè)第112頁(yè)第113頁(yè)第114頁(yè)第115頁(yè)第116頁(yè)第117頁(yè)第118頁(yè)第119頁(yè)第120頁(yè)第121頁(yè)第122頁(yè)第123頁(yè)第124頁(yè)第125頁(yè)第126頁(yè)第127頁(yè)第128頁(yè)第129頁(yè)第130頁(yè)第131頁(yè)第132頁(yè)第133頁(yè)第134頁(yè)第135頁(yè)第136頁(yè)第137頁(yè)第138頁(yè)第139頁(yè)第140頁(yè)第141頁(yè)第142頁(yè)第143頁(yè)第144頁(yè)第145頁(yè)第146頁(yè)第147頁(yè)第148頁(yè)第149頁(yè)第150頁(yè)第151頁(yè)第152頁(yè)第153頁(yè)第154頁(yè)第155頁(yè)第156頁(yè)第157頁(yè)第158頁(yè)第159頁(yè)第160頁(yè)第161頁(yè)第162頁(yè)第163頁(yè)第164頁(yè)第165頁(yè)第166頁(yè)當(dāng)前第167頁(yè)第168頁(yè)第169頁(yè)第170頁(yè)第171頁(yè)第172頁(yè)第173頁(yè)第174頁(yè)第175頁(yè)第176頁(yè)第177頁(yè)第178頁(yè)第179頁(yè)第180頁(yè)第181頁(yè)第182頁(yè)第183頁(yè)第184頁(yè)第185頁(yè)第186頁(yè)第187頁(yè)第188頁(yè)第189頁(yè)第190頁(yè)第191頁(yè)第192頁(yè)第193頁(yè)第194頁(yè)
    PIC18F2450/4450
    DS39760A-page 72
    Advance Information
    2006 Microchip Technology Inc.
    5.6.3
    MAPPING THE ACCESS BANK IN
    INDEXED LITERAL OFFSET MODE
    The use of Indexed Literal Offset Addressing mode
    effectively changes how the lower portion of Access
    RAM (00h to 5Fh) is mapped. Rather than containing
    just the contents of the bottom half of Bank 0, this mode
    maps the contents from Bank 0 and a user-defined
    “window” that can be located anywhere in the data
    memory space. The value of FSR2 establishes the
    lower boundary of the addresses mapped into the
    window, while the upper boundary is defined by FSR2
    plus 95 (5Fh). Addresses in the Access RAM above
    5Fh are mapped as previously described (see
    Section 5.3.3 “Access Bank”). An example of Access
    Bank remapping in this addressing mode is shown in
    Remapping of the Access Bank applies
    only to
    operations using the Indexed Literal Offset mode.
    Operations that use the BSR (Access RAM bit is ‘1’) will
    continue to use Direct Addressing as before. Any
    indirect or indexed operation that explicitly uses any of
    the indirect file operands (including FSR2) will continue
    to operate as standard Indirect Addressing. Any
    instruction that uses the Access Bank, but includes a
    register address of greater than 05Fh, will use Direct
    Addressing and the normal Access Bank map.
    5.6.4
    BSR IN INDEXED LITERAL
    OFFSET MODE
    Although the Access Bank is remapped when the
    extended instruction set is enabled, the operation of the
    BSR remains unchanged. Direct Addressing, using the
    BSR to select the data memory bank, operates in the
    same manner as previously described.
    FIGURE 5-9:
    REMAPPING THE ACCESS BANK WITH INDEXED LITERAL
    OFFSET ADDRESSING
    Data Memory
    000h
    100h
    200h
    F60h
    F00h
    FFFh
    Bank 1
    Bank 15
    Bank 2
    through
    Bank 14
    SFRs
    ADDWF f, d, a
    FSR2H:FSR2L = 120h
    Locations in the region
    from the FSR2 Pointer
    (120h) to the pointer plus
    05Fh (17Fh) are mapped
    to
    the
    bottom
    of
    the
    Access RAM (000h-05Fh).
    Special Function Regis-
    ters at F60h through FFFh
    are
    mapped
    to
    60h
    through FFh as usual.
    Bank 0 addresses below
    5Fh are not available in
    this mode. They can still
    be addressed by using the
    BSR.
    Access Bank
    00h
    60h
    FFh
    Bank 0
    SFRs
    Bank 1 “Window”
    Window
    Example Situation:
    120h
    17Fh
    5Fh
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    PDF描述
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