參數(shù)資料
型號(hào)： PIC16F785-I/SS
廠商： Microchip Technology
文件頁(yè)數(shù)： 46/206頁(yè)
文件大?。?/td> 0K
描述： IC PIC MCU FLASH 2KX14 20SSOP
產(chǎn)品培訓(xùn)模塊： Asynchronous Stimulus
8-bit PIC® Microcontroller Portfolio
標(biāo)準(zhǔn)包裝： 67
系列： PIC® 16F
核心處理器： PIC
芯體尺寸： 8-位
速度： 20MHz
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 17
程序存儲(chǔ)器容量： 3.5KB（2K x 14）
程序存儲(chǔ)器類型： 閃存
EEPROM 大?。?/td> 256 x 8
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 2 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 14x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 20-SSOP（0.209"，5.30mm 寬）
包裝： 管件
產(chǎn)品目錄頁(yè)面： 639 (CN2011-ZH PDF)
配用： XLT20SS1-1-ND - SOCKET TRANSITION 20DIP 20SSOP
XLT20SS-1-ND - SOCKET TRANSITION 18DIP 20SSOP
AC162060-ND - HEADER INTRFC MPLAB ICD2 20PIN
AC164307-ND - MODULE SKT FOR PM3 28SSOP
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PIC16F785/HV785
DS41249E-page 12
2008 Microchip Technology Inc.
TABLE 2-3:
PIC16F785/HV785 SPECIAL FUNCTION REGISTERS SUMMARY BANK 1
Addr
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Value on
POR, BOR
Page
Bank 1
80h
INDF
Addressing this location uses contents of FSR to address data memory (not a physical register)
xxxx xxxx
81h
OPTION_REG
RAPU
INTEDG
T0CS
T0SE
PSA
PS2
PS1
PS0
1111 1111
82h
PCL
Program Counter’s (PC) Least Significant Byte
0000 0000
83h
STATUS
IRP
RP1
RP0
TO
PD
ZDC
C
0001 1xxx
84h
FSR
Indirect Data Memory Address Pointer
xxxx xxxx
85h
TRISA
—
TRISA5
TRISA4
TRISA3
TRISA2
TRISA1
TRISA0
--11 1111
86h
TRISB
TRISB7
TRISB6
TRISB5
TRISB4
—
1111 ----
87h
TRISC
TRISC7
TRISC6
TRISC5
TRISC4
TRISC3
TRISC2
TRISC1
TRISC0
1111 1111
88h
—
Unimplemented
—
89h
—
Unimplemented
—
8Ah
PCLATH
—
Write Buffer for Upper 5 bits of Program Counter
---0 0000
8Bh
INTCON
GIE
PEIE
T0IE
INTE
RAIE
T0IF
INTF
RAIF
0000 000x
8Ch
PIE1
EEIE
ADIE
CCP1IE
C2IE
C1IE
OSFIE
TMR2IE
TMR1IE
0000 0000
8Dh
—
Unimplemented
—
8Eh
PCON
—
SBOREN
—
—POR
BOR
---1 --qq
8Fh
OSCCON
—
IRCF2
IRCF1
IRCF0
OSTS(1)
HTS
LTS
SCS
-110 q000
90h
OSCTUNE
—
TUN4
TUN3
TUN2
TUN1
TUN0
---0 0000
91h
ANSEL0
ANS7
ANS6
ANS5
ANS4
ANS3
ANS2
ANS1
ANS0
1111 1111
92h
PR2
Timer2 Module Period Register
1111 1111
93h
ANSEL1
—
ANS11
ANS10
ANS9
ANS8
---- 1111
94h
—
Unimplemented
—
95h
WPUA
—
WPUA5
WPUA4
WPUA3(2)
WPUA2
WPUA1
WPUA0
--11 1111
96h
IOCA
—
IOCA5
IOCA4
IOCA3
IOCA2
IOCA1
IOCA0
--00 0000
97h
—
Unimplemented
—
98h
REFCON
—
BGST
VRBB
VREN
VROE
CVROE
—
--00 000-
99h
VRCON
C1VREN
C2VREN
VRR
—
VR3
VR2
VR1
VR0
000- 0000
9Ah
EEDAT
EEDAT7
EEDAT6
EEDAT5
EEDAT4
EEDAT3
EEDAT2
EEDAT1
EEDAT0
0000 0000
9Bh
EEADR
EEADR7
EEADR6
EEADR5
EEADR4
EEADR3
EEADR2
EEADR1
EEADR0
0000 0000
9Ch
EECON1
—
WRERR
WREN
WR
RD
---- x000
9Dh
EECON2
EEPROM Control Register 2 (not a physical register)
---- ----
9Eh
ADRESL
Least Significant 2 bits of the left justified A/D result or 8 bits of the right justified result
xxxx xxxx
9Fh
ADCON1
—
ADCS2
ADCS1
ADCS0
—
-000 ----
Legend:
– = Unimplemented locations read as ‘0’, u = unchanged, x = unknown, q = value depends on condition, shaded = unimplemented
Note
1:
Bit resets to ‘0’ with Two-Speed Start-up and LP, XT or HS selected as the Oscillator mode or Fail-Safe mode is enabled, otherwise this
bit resets to ‘1’.
2:
RA3 pull-up is enabled when MCLRE is ‘1’ in Configuration Word.
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