參數(shù)資料
型號： PIC16F628-20/SO
廠商： Microchip Technology
文件頁數(shù)： 113/170頁
文件大?。?/td> 0K
描述： IC MCU FLASH 2KX14 COMP 18SOIC
產(chǎn)品培訓(xùn)模塊： Asynchronous Stimulus
8-bit PIC® Microcontroller Portfolio
標(biāo)準(zhǔn)包裝： 42
系列： PIC® 16F
核心處理器： PIC
芯體尺寸： 8-位
速度： 20MHz
連通性： UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 16
程序存儲器容量： 3.5KB（2K x 14）
程序存儲器類型： 閃存
EEPROM 大?。?/td> 128 x 8
RAM 容量： 224 x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 5.5 V
振蕩器型： 內(nèi)部
工作溫度： 0°C ~ 70°C
封裝/外殼： 18-SOIC（0.295"，7.50mm 寬）
包裝： 管件
配用： XLT18SO-1-ND - SOCKET TRANSITION 18SOIC 300MIL
AC164010-ND - MODULE SKT PROMATEII DIP/SOIC
其它名稱： PIC16F628-20/SOR
PIC16F628-20/SOR-ND
2003 Microchip Technology Inc.
Preliminary
DS40300C-page 45
PIC16F62X
6.3.1
SWITCHING PRESCALER
ASSIGNMENT
The prescaler assignment is fully under software
control (i.e., it can be changed “on the fly” during
program execution). Use the instruction sequences,
shown in Example 6-1, when changing the prescaler
assignment from Timer0 to WDT, to avoid an
unintended device RESET.
EXAMPLE 6-1:
CHANGING PRESCALER
(TIMER0
→WDT)
BCF
STATUS, RP0
;Skip if already in
;Bank 0
CLRWDT
;Clear WDT
CLRF
TMR0
;Clear TMR0 & Prescaler
BSF
STATUS, RP0
;Bank 1
MOVLW
'00101111’b
;These 3 lines
;(5, 6, 7)
MOVWF
OPTION_REG
;are required only
;if desired PS<2:0>
;are
CLRWDT
;000 or 001
MOVLW
'00101xxx’b
;Set Postscaler to
MOVWF
OPTION_REG
;desired WDT rate
BCF
STATUS, RP0
;Return to Bank 0
To change prescaler from the WDT to the TMR0
module use the sequence shown in Example 6-2. This
precaution must be taken even if the WDT is disabled.
EXAMPLE 6-2:
CHANGING PRESCALER
(WDT
→TIMER0)
CLRWDT
;Clear WDT and
;prescaler
BSF
STATUS, RP0
MOVLW
b'xxxx0xxx'
;Select TMR0, new
;prescale value and
;clock source
MOVWF
OPTION_REG
BCF
STATUS, RP0
TABLE 6-1:
REGISTERS ASSOCIATED WITH TIMER0
Address
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Value on
POR
Value on
All Other
RESETS
01h
TMR0
Timer0 module register
xxxx xxxx
uuuu uuuu
0Bh/8Bh/
10Bh/18Bh
INTCON
GIE
PEIE
T0IE
INTE
RBIE
T0IF
INTF
RBIF
0000 000x
0000 000u
81h, 181h
OPTION(2)
RBPU
INTEDG
T0CS
T0SE
PSA
PS2
PS1
PS0
1111 1111
85h
TRISA
TRISA7
TRISA6
TRISA5 TRISA4 TRISA3
TRISA2
TRISA1
TRISA0
1111 1111
Legend:
— = Unimplemented locations, read as ‘0’, u = unchanged, x = unknown
Note
1: Shaded bits are not used by TMR0 module.
2: Option is referred by OPTION_REG in MPLAB.
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