參數(shù)資料
型號： PIC12C672-10/SM
廠商： Microchip Technology
文件頁數(shù)： 68/129頁
文件大?。?/td> 0K
描述： IC MCU OTP 2KX14 A/D 8-SOIJ
產(chǎn)品培訓(xùn)模塊： Asynchronous Stimulus
8-bit PIC® Microcontroller Portfolio
標(biāo)準(zhǔn)包裝： 90
系列： PIC® 12C
核心處理器： PIC
芯體尺寸： 8-位
速度： 10MHz
外圍設(shè)備： POR，WDT
輸入/輸出數(shù)： 5
程序存儲器容量： 3.5KB（2K x 14）
程序存儲器類型： OTP
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 4x8b
振蕩器型： 內(nèi)部
工作溫度： 0°C ~ 70°C
封裝/外殼： 8-SOIC（0.209"，5.30mm 寬）
包裝： 管件
配用： XLT08SO-1-ND - SOCKET TRANSITION 8SOIC 150/208
AC164312-ND - MODULE SKT FOR PM3 16SOIC
ISPICR1-ND - ADAPTER IN-CIRCUIT PROGRAMMING
309-1048-ND - ADAPTER 8-SOIC TO 8-DIP
309-1047-ND - ADAPTER 8-SOIC TO 8-DIP
AC124001-ND - MODULE SKT PROMATEII 8DIP/SOIC
其它名稱： PIC12C672-10/SMR
PIC12C672-10/SMR-ND
1999 Microchip Technology Inc.
DS30561B-page 43
PIC12C67X
7.3.1
SWITCHING PRESCALER ASSIGNMENT
The prescaler assignment is fully under software con-
trol, (i.e., it can be changed “on-the-fly” during program
execution).
EXAMPLE 7-1:
CHANGING PRESCALER
(TIMER0
→WDT)
BCF
STATUS, RP0
;Bank 0
CLRF
TMR0
;Clear TMR0 & Prescaler
BSF
STATUS, RP0
;Bank 1
CLRWDT
;Clears WDT
MOVLW
b’xxxx1xxx’
;Select new prescale
MOVWF
OPTION_REG
;value & WDT
BCF
STATUS, RP0
;Bank 0
Note:
To avoid an unintended device RESET, the
following instruction sequence (shown in
Example 7-1) must be executed when
changing the prescaler assignment from
Timer0 to the WDT. This sequence must
be followed even if the WDT is disabled.
To change prescaler from the WDT to the Timer0 mod-
ule, use the sequence shown in Example 7-2.
EXAMPLE 7-2:
CHANGING PRESCALER
(WDT
→TIMER0)
CLRWDT
;Clear WDT and
;prescaler
BSF
STATUS, RP0 ;Bank 1
MOVLW
b’xxxx0xxx’ ;Select TMR0, new
;prescale value and
MOVWF
OPTION_REG
;clock source
BCF
STATUS, RP0 ;Bank 0
TABLE 7-1:
REGISTERS ASSOCIATED WITH TIMER0
Address Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Value on
POR
Value on
all other
Resets
01h
TMR0
Timer0 module’s register
xxxx xxxx
uuuu uuuu
0Bh/8Bh
INTCON
GIE
PEIE
T0IE
INTE
GPIE
T0IF
INTF
GPIF
0000 000x
0000 000u
81h
OPTION
GPPU
INTEDG
T0CS
T0SE
PSA
PS2
PS1
PS0
1111 1111
85h
TRIS
—
TRIS5
TRIS4
TRIS3
TRIS2
TRIS1
TRIS0
--11 1111
Legend: x = unknown, u = unchanged, - = unimplemented locations read as '0'. Shaded cells are not used by Timer0.
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