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參數(shù)資料
| 型號： | PI7C7300ANA |
| 廠商： | Pericom Semiconductor Corp. |
| 英文描述： | 3-PORT PCI-to-PCI BRIDGE |
| 中文描述： | 3端口PCI至PCI橋 |
| 文件頁數(shù)： | 76/109頁 |
| 文件大?。?/td> | 779K |
| 代理商： | PI7C7300ANA |
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PI7C7300A
3-PORT PCI-TO-PCI BRIDGE
ADVANCE INFORMATION
Page 76 OF 109
09/25/03 Revision 1.09
14.1.9
HEADER TYPE REGISTER – OFFSET 0Ch
Configuration Register 1
Bit
Function
23:16
Header Type
Type
R/O
Description
Read as 81h to designate function 0 (multiple function PCI-to-PCI
bridge for secondary bus S1)
Configuration Register 2
Bit
Function
23:16
Header Type
Type
R/O
Description
Read as 01h to designate function 1 (single function PCI-to-PCI
bridge for secondary bus S2)
14.1.10
PRIMARY BUS NUMBER REGISTER – OFFSET 18h
Bit
7:0
Function
Primary Bus
Number
Type
R/W
Description
Indicates the number of the PCI bus to which the primary interface
is connected. The value is set in software during configuration.
Reset to 0
14.1.11
SECONDARY (S1 or S2) BUS NUMBER REGISTER – OFFSET 18h
Bit
15:8
Function
Secondary (S1 or
S2) Bus Number
Type
R/W
Description
Indicates the number of the PCI bus to which the secondary
interface (S1 or S2) is connected. The value is set in software
during configuration.
Reset to 0
14.1.12
SUBORDINATE (S1 or S2) BUS NUMBER REGISTER – OFFSET
18h
Bit
23:16
Function
Subordinate
(S1 or S2) Bus
Number
Type
R/W
Description
Indicates the number of the PCI bus with the highest number that is
subordinate to the bridge. The value is set in software during
configuration.
Reset to 0
14.1.13
SECONDARY LATENCY TIMER REGISTER – OFFSET 18h
Bit
31:24
Function
Secondary
Latency Timer
Type
R/W
Description
Designated in units of PCI bus clocks. Latency timer checks for
master accesses on the secondary bus interfaces that remain
unclaimed by any target.
Reset to 0
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PDF描述 |
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參數(shù)描述 |
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