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參數(shù)資料
| 型號： | PDM41257LA10SOTR |
| 廠商： | IXYS CORP |
| 元件分類： | SRAM |
| 英文描述： | 256K X 1 STANDARD SRAM, 10 ns, PDSO24 |
| 封裝： | 0.300 INCH, PLASTIC, SOJ-24 |
| 文件頁數(shù)： | 5/7頁 |
| 文件大?。?/td> | 257K |
| 代理商： | PDM41257LA10SOTR |
PDM41257
Rev. 2.2 - 4/27/98
5
1
2
3
4
5
6
7
8
9
10
11
12
Read Cycle No. 1(1)
Read Cycle No. 2(2)
AC Electrical Characteristics
SHADED AREA = PRELIMINARY DATA.
Notes referenced are after Data Retention Table.
Description
-7(6)
-8(6)
-10(6)
-12
-15
READ Cycle
Sym
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
Units
READ cycle time
tRC
7
8
101215
ns
Address access time
tAA
7
8
10
12
15
ns
Chip enable access time
tACE
7
8
10
12
15
ns
Output hold from address change
tOH
3
3333
ns
Chip enable to output in low Z(3, 4, 5)
tLZCE
5
5555
ns
Chip disable to output in high Z(3, 4, 5)
tHZCE
5
10
ns
Chip enable to power up time(4)
tPU
0
0000
ns
Chip disable to power down time(4)
tPD
7
8
10
12
15
ns
tRC
tAA
tOH
PREVIOUS DATA VALID
DOUT
ADDR
DATA VALID
tRC
tACE
tAA
tLZCE
tHZCE
tLZOE
tHZOE
tAOE
ADDR
CE
DOUT
DATA VALID
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PDM41258S8SOTR | 64K X 4 STANDARD SRAM, 8 ns, PDSO24 |
| PDM41532LA15T | 128K X 8 STANDARD SRAM, 15 ns, PDSO44 |
| PDM44528SA10JTR | 32K X 18 CACHE SRAM, PQCC52 |
| PDM44528SA10JI | 32K X 18 CACHE SRAM, PQCC52 |
| PDM44528S7JTR | 32K X 18 CACHE SRAM, PQCC52 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PDM41257LA10SOTY | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x1 SRAM |
| PDM41257LA12DI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x1 SRAM |
| PDM41257LA12SO | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x1 SRAM |
| PDM41257LA12SOI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x1 SRAM |
| PDM41257LA12SOITR | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x1 SRAM |
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