參數(shù)資料
型號： PDI1394L41
廠商： NXP Semiconductors N.V.
英文描述： Content Protection AV Link Layer(內(nèi)容可保護(hù)的AV鏈接層控制器)
中文描述： 影音內(nèi)容保護(hù)鏈路層（內(nèi)容可保護(hù)的視聽鏈接層控制器）
文件頁數(shù)： 2/81頁
文件大?。?/td> 303K
代理商： PDI1394L41
Philips Semiconductors
Preliminary specification
PDI1394L41
1394 content protection AV link layer controller
2000 Apr 15
i
1.0
2.0
3.0
4.0
5.0
6.0
7.0
8.0
9.0
FEATURES
DESCRIPTION
QUICK REFERENCE DATA
ORDERING INFORMATION
PIN CONFIGURATION
FUNCTIONAL DIAGRAM
INTERNAL BLOCK DIAGRAM
APPLICATION DIAGRAM
PIN DESCRIPTION
9.1
Host Interface
9.2
AV Interface 1
9.3
AV Interface 2
9.4
Phy Interface
9.5
Other Pins
10.0
RECOMMENDED OPERATING CONDITIONS
11.0
ABSOLUTE MAXIMUM RATINGS
12.0
FUNCTIONAL DESCRIPTION
12.1
Overview
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12.2
AV interface and AV layer
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12.2.1
IEC 61883 International Standard
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12.2.2
CIP Headers
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12.2.3
The AV Interface
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12.2.4
Content Protection
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12.2.5
mLAN Support
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12.2.6
SY – Sync Support
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12.2.7
Programmable Buffer Memory
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12.3
Bushold and Link/PHY single capacitor galvanic isolation
12.3.1
Bushold
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12.3.2
Single capacitor isolation
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12.4
Power Management
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12.5
The host interface
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12.5.1
Read accesses
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12.5.2
Write accesses
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12.5.3
Big and little endianness, data invariance, and data bus width
12.5.4
Accessing the asynchronous packet queues
12.5.5
The CPU bus interface signals
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
12.6
The Asynchronous Packet Interface
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12.6.1
Reading an Asynchronous Packet
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
12.6.2
Link Packet Data Formats
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12.7
Interrupts
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13.0
REGISTER MAP
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13.1
Link Control Registers
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13.1.1
ID Register (IDREG) – Base Address: 0x000
13.1.2
General Link Control (LNKCTL) – Base Address: 0x004
13.1.3
Link /Phy Interrupt Acknowledge (LNKPHYINTACK) – Base Address: 0x008
13.1.4
Link / Phy Interrupt Enable (LNKPHYINTE) – Base Address: 0x00C
13.1.5
Cycle Timer Register (CYCTM) – Base Address: 0x010
13.1.6
Phy Register Access (PHYACS) – Base Address: 0x014
13.1.7
Global Interrupt Status and TX Control (GLOBCSR) – Base Address: 0x018
13.1.8
Timer (TIMER) – Base Address: 0x01C
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
13.2
AV (Isochronous) Transmitter and Receiver Registers
13.2.1
Isochronous Transmit Packing Control and Status (ITXPKCTL) – Base Address: 0x020
13.2.2
Common Isochronous Transmit Packet Header Quadlet 1 (ITXHQ1) – Base Address: 0x024
13.2.3
Common Isochronous Transmit Packet Header Quadlet 2 (ITXHQ2) – Base Address: 0x028
1
1
1
1
2
3
3
4
4
4
5
6
7
7
8
8
9
9
9
9
9
9
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10
11
11
11
12
12
13
13
14
14
15
16
17
18
26
26
26
40
41
46
46
46
48
49
49
50
50
51
52
52
53
53
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PDF描述
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相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
PDI1394L41BE 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:1394 content protection AV link layer controller
PDI1394P11 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:3-port physical layer interface
PDI1394P11A 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:3-port physical layer interface
PDI1394P11ABD 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:3-port physical layer interface
PDI1394P11ABD-S 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Transceiver
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