參數(shù)資料
型號(hào)： PCM1744
英文描述： 24 Bits, 96kHz, Sampling Stereo Audio DIGITAL-TO-ANALOG CONVERTER
中文描述： 24位，96kHz的，采樣的立體聲音頻數(shù)字模擬轉(zhuǎn)換器
文件頁(yè)數(shù)： 6/9頁(yè)
文件大小： 83K
代理商： PCM1744
6
PCM1744
FIGURE 1. I
2
S Data Input Timing.
FIGURE 2. Audio Data Input Timing.
SYSTEM CLOCK
The system clock for PCM1744 must be either 256f
S
or
384f
S
, where f
S
is the audio sampling frequency (LRCIN),
typically 32kHz, 44.1kHz, 48kHz, 88.2kHz or 96kHz. The
system clock is used to operate the digital filter and the noise
shaper. The system clock input (SCKI) is at pin 14. Timing
conditions for SCKI are shown in Figure 3.
PCM1744 has a system clock detection circuit which auto-
matically detects the frequency, either 256f
S
or 384f
S
. The
system clock should be synchronized with LRCIN (pin 1),
but PCM1744 can compensate for phase differences. If the
phase difference between LRCIN and system clock is greater
System Clock Pulse Width High
System Clock Pulse Width Low
t
SCKIH
t
SCKIL
13ns (min)
13ns (min)
FIGURE 3. System Clock Timing Requirements.
LRCKIN
BCKIN
DIN
1.4V
1.4V
1.4V
t
BCH
t
BCL
t
LB
t
BL
t
DS
BCKIN Pulse Cycle Time
BCKIN Pulse Width High
BCKIN Pulse Width Low
BCKIN Rising Edge to LRCIN Edge
LRCIN Edge to BCKIN Rising Edge
DIN Set-up Time
DIN Hold Time
: t
BCY
: t
BCH
: t
BCL
: t
BL
: t
LB
: t
DS
: t
DH
: 100ns (min)
: 50ns (min)
: 50ns (min)
: 30ns (min)
: 30ns (min)
: 30ns (min)
: 30ns (min)
t
DH
t
BCY
t
SCKIH
SCKI
t
SCKIL
2.0V
0.8V
1
2
3
20
21
1/f
S
L_ch
R_ch
MSB
LSB
22
23
24
21
20
22
23
24
LRCIN (pin 1)
BCKIN (pin 3)
AUDIO DATA WORD = 24-BIT
DIN (pin 2)
1
2
3
MSB
LSB
2
1
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