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參數(shù)資料
| 型號： | PC8245MTPU333D |
| 廠商： | ATMEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Integrated Processor Family |
| 中文描述： | 32-BIT, 333 MHz, RISC PROCESSOR, PBGA352 |
| 封裝： | 35 X 35 MM, 1.27 MM PITCH, TBGA-352 |
| 文件頁數(shù)： | 36/61頁 |
| 文件大小： | 429K |
| 代理商： | PC8245MTPU333D |
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36
PC8245
2171D–HIREL–06/04
I
2
C AC Timing Specifications
Table 11 provides the I
2
C interface input AC timing specifications for the PC8245 at rec-
ommended operating conditions (see Table “Recommended Operating Conditions” on
page 12) with L
V
DD
= 3.3V
±
0.3V.
Notes:
1. Units for these specifications are in SDRAM_CLK units.
2. The actual values depend on the setting of the digital filter frequency sampling rate (DFFSR) bits in the frequency divider
register I2CFDR. Therefore, the noted timings in the above table are all relative to qualified signals. The qualified SCL and
SDA are delayed signals from what is seen in real time on the
I
2
C interface
bus. The qualified SCL, SDA signals are
delayed by the SDRAM_CLK clock times DFFSR times 2 plus 1 SDRAM_CLK clock. The resulting delay value is added to
the value in the table (where this note is referenced). See Figure 19 on page 39.
3. Timing is relative to the Sampling Clock (not SCL).
4. FDR[x] refers to the Frequency Divider Register I2CFDR bit x.
5. Input clock low and high periods in combination with the FDR value in the Frequency Divider Register (I2CFDR) determine
the maximum
I
2
C interface
input frequency. See Table 12.
Table 11.
I
2
C interface Input AC Timing Specifications
Number
Characteristics
Min
Max
Unit
Notes
1
Start condition hold time
4.0
–
CLKs
(1)(2)
2
Clock low period
(time before the PC8245 will drive SCL low as a
transmitting slave after detecting SCL low as driven
by an external master.)
8.0 + (16 x 2
FDR[4:2]
) x (5 -
4({FDR[5],FDR[1]} == b’10) -
3({FDR[5],FDR[1]} == b’11) -
2({FDR[5],FDR[1]} == b’00) -
1({FDR[5],FDR[1]} == b’01))
–
CLKs
(1)(2)(4)(5)
3
SCL/SDA rise time (from 0.5V to 2.4V)
–
1
ms
4
Data hold time
0
–
ns
(2)
5
SCL/SDA fall time (from 2.4V to 0.5V)
–
1
ms
6
Clock high period
(Time needed to either receive a data bit or
generate a START or STOP.)
5.0
–
CLKs
(1)(2)(5)
7
Data setup time
3.0
–
ns
(3)
8
Start condition setup time (for repeated start
condition only)
4.0
–
CLKs
(1)(2)
9
Stop condition setup time
4.0
–
CLKs
(1)(2)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PC824A | NPN-OUTPUT DC-INPUT OPTOCOUPLER |
| PC844A | NPN-OUTPUT AC-INPUT OPTOCOUPLER |
| PC844X | PHOTOCOUPLER |
| PC844 | DEVICE SPECIFICATION FOR PHOTOCOUPLER |
| PC8250C | |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PC8245MTPU350D | 制造商:e2v technologies 功能描述:PC8245MTPU350D - Trays |
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| PC825 | 功能描述:PHOTOCOUPLER 2CH DARL OUT 8-DIP RoHS:否 類別:隔離器 >> 光隔離器 - 晶體管，光電輸出 系列:- 標(biāo)準(zhǔn)包裝:1,000 系列:- 通道數(shù):2 輸入類型:DC 電壓 - 隔離:2500Vrms 電流傳輸比（最小值）:7% @ 16mA 電流傳輸比（最大）:50% @ 16mA 輸出電壓:20V 電流 - 輸出 / 通道:8mA 電流 - DC 正向(If):25mA Vce飽和（最大）:- 輸出類型:有 Vcc 的晶體管 安裝類型:通孔 封裝/外殼:8-DIP（0.400"，10.16mm） 包裝:管件 其它名稱:HCPL-2530W |
| PC-825 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:High Sensitivity High Density Mounting Type Photocoupler(232.40 k) |
| PC8250A | 制造商:未知廠家 制造商全稱:未知廠家 功能描述: |
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