參數(shù)資料
型號(hào)： P9S12XEP100J1VALR
廠商： 飛思卡爾半導(dǎo)體(中國(guó))有限公司
英文描述： Microcontrollers
中文描述： 微控制器
文件頁(yè)數(shù)： 321/1036頁(yè)
文件大?。?/td> 3356K
代理商： P9S12XEP100J1VALR
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Chapter 8 S12X Debug (S12XDBGV3) Module
MC9S12XE-Family Reference Manual Rev. 1.07
Freescale Semiconductor
321
8.3.2.8.1
Debug Comparator Control Register (DBGXCTL)
The contents of this register bits 7 and 6 differ depending upon which comparator registers are visible in
the 8-byte window of the DBG module register address map.
Read: Anytime. See
Table 8-28
for visible register encoding.
Write: If DBG not armed. See
Table 8-28
for visible register encoding.
The DBGC1_COMRV bits determine which comparator control, address, data and datamask registers are
visible in the 8-byte window from 0x0028 to 0x002F as shown in
Section Table 8-28.
Table 8-28. Comparator Address Register Visibility
Address: 0x0028
7
0
6
5
4
3
2
1
0
R
W
NDB
TAG
BRK
RW
RWE
SRC
COMPE
Reset
0
0
0
0
0
0
0
0
= Unimplemented or Reserved
Figure 8-13. Debug Comparator Control Register (Comparators A and C)
Address: 0x0028
7
6
5
4
3
2
1
0
R
W
SZE
SZ
TAG
BRK
RW
RWE
SRC
COMPE
Reset
0
0
0
0
0
0
0
0
Figure 8-14. Debug Comparator Control Register (Comparators B and D)
COMRV
Visible Comparator
00
DBGACTL, DBGAAH ,DBGAAM, DBGAAL, DBGADH, DBGADL, DBGADHM, DBGADLM
01
DBGBCTL, DBGBAH, DBGBAM, DBGBAL
10
DBGCCTL, DBGCAH, DBGCAM, DBGCAL, DBGCDH, DBGCDL, DBGCDHM, DBGCDLM
11
DBGDCTL, DBGDAH, DBGDAM, DBGDAL
Table 8-29. DBGXCTL Field Descriptions
Field
Description
7
SZE
(Comparators
B and D)
Size Comparator Enable Bit
— The SZE bit controls whether access size comparison is enabled for the
associated comparator. This bit is ignored if the TAG bit in the same register is set.
0 Word/Byte access size is not used in comparison
1 Word/Byte access size is used in comparison
6
NDB
(Comparators
A and C
Not Data Bus
— The NDB bit controls whether the match occurs when the data bus matches the comparator
register value or when the data bus differs from the register value. Furthermore data bus bits can be
individually masked using the comparator data mask registers. This bit is only available for comparators A
and C. This bit is ignored if the TAG bit in the same register is set. This bit position has an SZ functionality for
comparators B and D.
0 Match on data bus equivalence to comparator register contents
1 Match on data bus difference to comparator register contents
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PDF描述
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