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參數(shù)資料
| 型號： | P9S12XEP100J1VAL |
| 廠商： | 飛思卡爾半導體(中國)有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 233/1036頁 |
| 文件大?。?/td> | 3356K |
| 代理商： | P9S12XEP100J1VAL |
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Chapter 4 Memory Protection Unit (S12XMPUV1)
MC9S12XE-Family Reference Manual Rev. 1.07
Freescale Semiconductor
233
Table 4-9. MPUDESC1 Field Descriptions
4.3.1.8
MPU Descriptor Register 2 (MPUDESC2)
Figure 4-10. MPU Descriptor Register 2 (MPUDESC2)
Read: Anytime
Write: Anytime
Table 4-10. MPUDESC2 Field Descriptions
4.3.1.9
MPU Descriptor Register 3 (MPUDESC3)
Figure 4-11. MPU Descriptor Register 3 (MPUDESC3)
Read: Anytime
Write: Anytime
Table 4-11. MPUDESC3 Field Descriptions
Field
Description
7–0
LOW_ADDR[
18:11]
Memory range lower boundary address bits
— The LOW_ADDR[18:11] bits represent bits [18:11] of the
global memory address that is used as the lower boundary for the described memory range.
Address: Module Base + 0x0008
7
6
5
4
3
2
1
0
R
W
LOW_ADDR[10:3]
Reset
0
0
0
0
0
0
0
0
Field
Description
7–0
LOW_ADDR[
10:3]
Memory range lower boundary address bits
— The LOW_ADDR[10:3] bits represent bits [10:3] of the global
memory address that is used as the lower boundary for the described memory range.
Address: Module Base + 0x0009
7
6
5
0
4
0
3
2
1
0
R
W
WP
NEX
HIGH_ADDR[22:19]
Reset
0
0
0
0
1
1
1
1
Field
Description
7
WP
Write-Protect bit
— The WP bit causes the described memory range to be treated as write-protected. If this
bit is set every attempt to write in the described memory range causes an access violation.
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