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參數資料
| 型號： | P3S12XEP100J1VAG |
| 廠商： | 飛思卡爾半導體(中國)有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數： | 64/1036頁 |
| 文件大小： | 3356K |
| 代理商： | P3S12XEP100J1VAG |
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Chapter 1 Device Overview MC9S12XE-Family
MC9S12XE-Family Reference Manual , Rev. 1.07
64
Freescale Semiconductor
1.3
System Clock Description
The clock and reset generator module (CRG) provides the internal clock signals for the core and all
peripheral modules.
Figure 1-8
shows the clock connections from the CRG to all modules.
Consult the CRG specification for details on clock generation.
Figure 1-8. Clock Connections
The system clock can be supplied in several ways enabling a range of system operating frequencies to be
supported:
The on-chip phase locked loop (PLL)
the PLL self clocking
the oscillator
The clock generated by the PLL or oscillator provides the main system clock frequencies core clock and
bus clock. As shown in
Figure 1-8
, these system clocks are used throughout the MCU to drive the core,
the memories, and the peripherals.
SCI0 . . SCI 7
SPI0 . . SPI2
IIC0 & IIC1
ATD0 & ATD1
CAN0 . . CAN4
CRG
Bus Clock
EXTAL
XTAL
Core Clock
Oscillator Clock
RAM
S12X
XGATE
FLASH &
EEE
PIT
ECT
PIM
PWM
TIM
相關PDF資料 |
PDF描述 |
|---|---|
| P3S12XEP100J1VAGR | Microcontrollers |
| P3S12XEP100J1VAL | Microcontrollers |
| P3S12XEP100J1VALR | Microcontrollers |
| P3S12XEP100J1VVL | Microcontrollers |
| P3S12XEP100J1VVLR | Microcontrollers |
相關代理商/技術參數 |
參數描述 |
|---|---|
| P3S12XEP100J1VAGR | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| P3S12XEP100J1VAL | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| P3S12XEP100J1VALR | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| P3S12XEP100J1VVL | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| P3S12XEP100J1VVLR | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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