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參數(shù)資料
| 型號： | P3S12XEP100J1CALR |
| 廠商： | 飛思卡爾半導體(中國)有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 164/1036頁 |
| 文件大?。?/td> | 3356K |
| 代理商： | P3S12XEP100J1CALR |
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Chapter 2 Port Integration Module (S12XEPIMV1)
MC9S12XE-Family Reference Manual , Rev. 1.07
164
Freescale Semiconductor
2.3.94
Port L Input Register (PTIL)
2.3.95
Port L Data Direction Register (DDRL)
Address 0x0371
Access: User read
1
1
Read: Anytime.
Write:Never, writes to this register have no effect.
7
6
5
4
3
2
1
0
R
PTIL7
PTIL6
PTIL5
PTIL4
PTIL3
PTIL2
PTIL1
PTIL0
W
Reset
u
u
u
u
u
u
u
u
= Unimplemented or Reserved
u = Unaffected by reset
Figure 2-92. Port L Input Register (PTIL)
Table 2-88. PTIL Register Field Descriptions
Field
Description
7-0
PTIL
Port L input data
—
This register always reads back the buffered state of the associated pins. This can also be used to detect overload
or short circuit conditions on output pins.
Address 0x0372
Access: User read/write
1
1
Read: Anytime.
Write: Anytime.
7
6
5
4
3
2
1
0
R
DDRL7
DDRL6
DDRL5
DDRL4
DDRL3
DDRL2
DDRL1
DDRL0
W
Reset
0
0
0
0
0
0
0
0
Figure 2-93. Port L Data Direction Register (DDRL)
Table 2-89. DDRL Register Field Descriptions
Field
Description
7-0
DDRL
Port L data direction
—
This register controls the data direction of pins 7 through 0.This register configures each Port L pin as either input
or output.
If SPI0 is enabled, the SPI0 determines the pin direction.
Refer to SPI section for details
.
If the associated SCI transmit or receive channel is enabled this register has no effect on the pins. The pin is forced
to be an output if a SCI transmit channel is enabled, it is forced to be an input if the SCI receive channel is enabled.
The data direction bits revert to controlling the I/O direction of a pin when the associated channel is disabled.
1 Associated pin is configured as output.
0 Associated pin is configured as input.
相關PDF資料 |
PDF描述 |
|---|---|
| P3S12XEP100J1CVL | Microcontrollers |
| P3S12XEP100J1CVLR | Microcontrollers |
| P3S12XEP100J1MAA | Microcontrollers |
| P3S12XEP100J1MAAR | Microcontrollers |
| P3S12XEP100J1MAG | Microcontrollers |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| P3S12XEP100J1CVL | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| P3S12XEP100J1CVLR | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| P3S12XEP100J1MAA | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| P3S12XEP100J1MAAR | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| P3S12XEP100J1MAG | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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