參數(shù)資料
型號(hào): OR3T80-6BC600I
元件分類: FPGA
英文描述: FPGA, 484 CLBS, 58000 GATES, 80 MHz, PBGA600
封裝: BGA-600
文件頁數(shù): 33/210頁
文件大?。?/td> 2138K
代理商: OR3T80-6BC600I
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Preliminary Data Sheet, Rev. 1
ORCA Series 3 FPGAs
September 1998
128
Lucent Technologies Inc.
Timing Characteristics (continued)
Note: Serial configuration data is transmitted out on DOUT on the falling edge of CCLK after it is input DIN.
Figure 79. Master Serial Configuration Mode Timing Diagram
Table 60. Master Serial Configuration Mode Timing Characteristics
OR3Cxx Commercial: VDD = 5.0 V ± 5%, 0 °C
< TA < 70 °C; Industrial: VDD = 5.0 V ± 10%, –40 °C < TA < +85 °C.
OR3Txxx Commercial: VDD = 3.0 V to 3.6 V, 0 °C
< TA < 70 °C; Industrial: VDD = 3.0 V to 3.6 V, –40 °C < TA < +85 °C.
Parameter
Symbol
Min
Max
Unit
DIN Setup Time
TS
60.00
ns
DIN Hold Time
TH
0.00
ns
CCLK Frequency (M3 = 0)
FC
5.00
16.67
MHz
CCLK Frequency (M3 = 1)
FC
0.63
2.08
MHz
CCLK to DOUT Delay
TD
—5.00
ns
5-4532(F)
DIN
CCLK
DOUT
TS
TH
BIT N
TD
BIT N
5-4532(F)
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PDF描述
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