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參數(shù)資料
| 型號： | OR2T04A-5T208 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 元件分類： | FPGA |
| 英文描述： | Field-Programmable Gate Arrays |
| 中文描述： | 現(xiàn)場可編程門陣列 |
| 文件頁數(shù)： | 109/192頁 |
| 文件大?。?/td> | 3148K |
| 代理商： | OR2T04A-5T208 |
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Data Sheet
June 1999
ORCA Series 2 FPGAs
Lucent Technologies Inc.
109
AD13
AE15
AD14
AF15
AE16
AD15
AF16
AC15
AE17
AD16
AF17
AC17
AE18
AD17
AF18
AE19
AF19
AD18
AE20
AC19
AF20
AD19
AE21
AC20
AF21
AD20
AE22
AF22
AD21
AE23
AC22
AF23
AD22
AE24
AD23
AF24
AE26
AD25
AD26
PB9D
PB10A
PB10B
PB10C
PB10D
PB11A
PB11B
PB11C
PB11D
PB12A
PB12B
PB12C
PB12D
PB13A
PB13B
—
PB13C
PB13D
—
PB14A
—
PB14B
PB14C
PB14D
PB15A
PB15B
PB15C
PB15D
PB16A
—
PB16B
PB16C
PB16D
—
—
DONE
RESET
PRGM
PR16A
PB10D
PB11A
PB11B
PB11C
PB11D
PB12A
PB12B
PB12C
PB12D
PB13A
PB13B
PB13C
PB13D
PB14A
PB14B
PB14C
PB14D
PB15A
PB15B
PB15C
PB15D
PB16A
PB16B
PB16C
PB16D
PB17A
PB17B
PB17C
PB17D
—
PB18A
PB18B
PB18C
—
PB18D
DONE
RESET
PRGM
PR18A
PB11D
PB12A
PB12B
PB12C
PB12D
PB13A
PB13B
PB13C
PB13D
PB14A
PB14B
PB14C
PB14D
PB15A
PB15B
PB15C
PB15D
PB16A
PB16B
PB16C
PB16D
PB17A
PB17B
PB17C
PB17D
PB18A
PB18B
PB18D
PB19A
PB19C
PB19D
PB20A
PB20B
PB20C
PB20D
DONE
RESET
PRGM
PR20A
PB13D
PB14A
PB14D
PB15A
PB15D
PB16A
PB16D
PB17A
PB17D
PB18A
PB18B
PB18C
PB18D
PB19A
PB19B
PB19C
PB19D
PB20A
PB20B
PB20C
PB20D
PB21A
PB21B
PB21C
PB21D
PB22A
PB22B
PB22D
PB23A
PB23B
PB23D
PB24A
PB24B
PB24C
PB24D
DONE
RESET
PRGM
PR24A
PB16D
V
DD
5
PB17D
PB18A
PB18D
PB19A
PB19D
PB20A
PB20D
PB21A
PB21D
PB22A
PB22D
PB23A
PB24A
PB24C
PB24D
PB25A
PB25B
PB25C
PB25D
V
DD
5
PB26B
PB26C
PB26D
PB27A
PB27B
PB27D
PB28A
PB28B
PB28D
PB29A
PB29D
PB30C
PB30D
PDONE
PRESETN
PPRGMN
PR30A
I/O
I/O-V
DD
5
I/O
I/O
I/O
I/O-HDC
I/O
I/O
I/O
I/O-
LDC
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O-
INIT
I/O
I/O
I/O
I/O-V
DD
5
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
DONE
RESET
PRGM
I/O-M0
Pin Information
(continued)
Table 27. OR2C/2T10A, OR2C/2T12A, OR2C/2T15A/B, OR2C/2T26A, and OR2T40A/B 352-Pin PBGA
Pinout
(continued)
Pin
2C/2T10A Pad
2C/2T12A Pad
2C/2T15A/B Pad
2C/2T26A Pad OR2T40A/B Pad
Function
Notes:
The pins labeled I/O-V
DD
5 are user I/Os for the OR2CxxA and OR2TxxB series, but they are connected to V
DD
5 for the OR2TxxA series.
The pins labeled V
SS
-ETC are the 6 x 6 array of thermal balls located at the center of the package. The balls can be attached to the ground plane
of the board for enhanced thermal capability (see Table 29), or they can be left unconnected.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| OR2T04A-5T208I | Field-Programmable Gate Arrays |
| OR2T04A-5T84 | Field-Programmable Gate Arrays |
| OR2T04A-5T84I | Field-Programmable Gate Arrays |
| OR2T04A-6BA208 | Field-Programmable Gate Arrays |
| OR2T04A-6BA208I | Field-Programmable Gate Arrays |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| OR2T04A-5T208I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Gate Arrays |
| OR2T04A-5T84 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Gate Arrays |
| OR2T04A-5T84I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Gate Arrays |
| OR2T04A-6BA100 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Gate Arrays |
| OR2T04A-6BA100I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Gate Arrays |
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