- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄383713 > OR2C40A-7T208I (Electronic Theatre Controls, Inc.) Ceramic Chip Capacitors / MIL-PRF-55681; Capacitance [nom]: 10pF; Working Voltage (Vdc)[max]: 100V; Capacitance Tolerance: +/-1%; Dielectric: Multilayer Ceramic; Temperature Coefficient: C0G (NP0); Lead Style: Surface Mount Chip; Lead Dimensions: 1206; Termination: Solder Coated SnPb; Body Dimensions: 0.125" x 0.062" x 0.051"; Container: Bag; Features: MIL-PRF-55681: P Failure Rate PDF資料下載
參數(shù)資料
| 型號(hào)： | OR2C40A-7T208I |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Ceramic Chip Capacitors / MIL-PRF-55681; Capacitance [nom]: 10pF; Working Voltage (Vdc)[max]: 100V; Capacitance Tolerance: +/-1%; Dielectric: Multilayer Ceramic; Temperature Coefficient: C0G (NP0); Lead Style: Surface Mount Chip; Lead Dimensions: 1206; Termination: Solder Coated SnPb; Body Dimensions: 0.125" x 0.062" x 0.051"; Container: Bag; Features: MIL-PRF-55681: P Failure Rate |
| 中文描述： | 現(xiàn)場(chǎng)可編程門陣列 |
| 文件頁數(shù)： | 93/192頁 |
| 文件大?。?/td> | 3148K |
| 代理商： | OR2C40A-7T208I |
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Data Sheet
June 1999
ORCA Series 2 FPGAs
Lucent Technologies Inc.
93
P3
R2
T1
P4
R3
T2
U1
T3
U2
V1
T4
U3
V2
W1
V3
W2
Y1
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U5
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V6
U7
W6
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W8
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U9
V9
W9
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PL10D
PL10C
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—
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—
—
—
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—
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—
—
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CCLK
PB1A
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PL15D
PL15B
PL15A
PL16D
PL16B
PL17D
PL18D
PL18C
PL18A
PL19D
PL19C
PL19A
PL20D
PL20A
CCLK
PB1A
PB1D
PB2A
PB2D
PB3A
PB3C
PB3D
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PB5D
PB6A
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PB7A
PB7B
PB7D
PB8A
PB8B
PB8C
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PB9A
PB9B
PB9C
PB9D
I/O-A12
I/O
I/O
I/O-A13
I/O
I/O
I/O
I/O-A14
I/O-V
DD
5
I/O
I/O
I/O
I/O
I/O
I/O
I/O-A15
CCLK
I/O-A16
I/O
I/O
I/O-V
DD
5
I/O
I/O
I/O
I/O-A17
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
Pin Information
(continued)
Table 25. OR2C/2T06A, OR2C/2T08A, OR2C/2T10A, OR2C/2T12A, and OR2C/2T15A/B
256-Pin PBGA Pinout
(continued)
Pin
2C/2T06A Pad
2C/2T08A Pad
2C/2T10A Pad
2C/2T12A Pad
2C/2T15A/B Pad
Function
Notes:
The W3 pin on the 256-pin PBGA package is unconnected for all devices listed in this table.
The OR2C/2T08A do not have bond pads connected to the 256-pin PBGA package pins F2 and Y17.
The pins labeled I/O-V
DD
5 are user I/Os for the OR2CxxA and OR2TxxB series, but they are connected to V
DD
5 for the OR2TxxA series.
The pins labeled V
SS
-ETC are the 4 x 4 array of thermal balls located at the center of the package. The balls can be attached to the ground
plane of the board for enhanced thermal capability (see Table 29), or they can be left unconnected.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| OR2C40A-7T240 | Field-Programmable Gate Arrays |
| OR2C40A-7T240I | Field-Programmable Gate Arrays |
| OR2C40A-7T304 | Field-Programmable Gate Arrays |
| OR2C40A-7T304I | Field-Programmable Gate Arrays |
| OR2C40A-7T352 | Field-Programmable Gate Arrays |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| OR2T04A | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:Field-Programmable Gate Arrays |
| OR2T04A-2BA100 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Gate Arrays |
| OR2T04A-2BA100I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Gate Arrays |
| OR2T04A-2BA144 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Gate Arrays |
| OR2T04A-2BA144I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Gate Arrays |
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