參數(shù)資料
型號(hào)： NB7N017MMNR2G
廠商： ON Semiconductor
文件頁數(shù)： 3/19頁
文件大?。?/td> 0K
描述： IC DIVIDER 8BIT DUAL CML 52-QFN
標(biāo)準(zhǔn)包裝： 2,000
類型： 時(shí)鐘除法器
PLL： 無
輸入： CML，ECL，LVCMOS，LVDS，LVTTL
輸出： CML
電路數(shù)： 1
比率 - 輸入:輸出： 1:1
差分 - 輸入:輸出： 是/是
頻率 - 最大： 3.5GHz
除法器/乘法器： 是/無
電源電壓： ±3 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 52-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝： 52-QFN（8x8）
包裝： 帶卷 (TR)
NB7N017M
http://onsemi.com
11
Application Information
All NB7N017M inputs can accept PECL, CML, LVTTL,
LVCMOS and LVDS signal levels. The limitations for
differential input signal (LVDS, PECL, or CML) are
minimum input swing of 100 mV and the maximum input
swing of 450 mV. Within these conditions, the input
voltage can range from VCC to 1.2 V. Examples interfaces
are illustrated below in a 50
W environment (Z = 50 W).
50 W
VCC
CLK
50 W
7N017M
VCC VTCLK
VEE
VCC
Q
50 W 50 W
7N017M
VEE
Figure 6. CML to CML Interface
Z
Q
Z
50 W
Z
VCC
LVDS
Driver
50 W
7N017M
VEE
Figure 7. PECL to CML Receiver Interface
50 W
Z
VCC
PECL
Driver
CLK
50 W
7N017M
VEE
VBIAS*
VTCLK
VEE
RT
VEE
VCC
RT
5.0 V 290 W
3.3 V 150 W
2.5 V 80 W
Recommended RT Values
50 W
VCC V
TCLK
VBIAS*
VTCLK
CLK
VTCLK
Figure 8. LVDS to CML Receiver Interface
*VBIAS is within VCMR Range.
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PDF描述
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參數(shù)描述
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