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參數(shù)資料
| 型號： | NB3N65027DTG |
| 廠商： | ON Semiconductor |
| 文件頁數(shù)： | 2/7頁 |
| 文件大小： | 0K |
| 描述： | IC CLK SYNTHESIZER 3-PLL 20-QSOP |
| 標準包裝： | 55 |
| 類型： | * |
| PLL： | 是 |
| 輸入： | LVCMOS，LVTTL，晶體 |
| 輸出： | LVCMOS，LVTTL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:7 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 125MHz |
| 除法器/乘法器： | 是/是 |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 20-SSOP（0.154"，3.90mm 寬） |
| 供應商設備封裝： | 20-QSOP |
| 包裝： | 管件 |
NB3N65027
http://onsemi.com
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3
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Figure 2. Pinout: QSOP20 (Top View)
20
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ACS0
X2
X1/ICLK
VDD
ACS1
GND
CLKC1
CLKC2
CLKB2
CLKB1
BCS1
BCS0
REFOUT
CLKA1
VDD
OE
GND
CLKA2
NC
CCS
Table 1. PIN DESCRIPTION (Note 1)
Pin Number
Pin Name
Pin Type
Pin Description
1
ACS0
TriLevel Input
A Clock Select 0. Selects outputs on CLKA1 and CLKA2 per table on page 3.
2
X2
Input
Crystal connection. Connect to a fundamental crystal or leave unconnected for a clock
input.
3
X1/ICLK
Input
Crystal or Clock input connection. If a clock input is used, drive it into X1 and leave X2
unconnected.
4
VDD
Power
Connect to +3.3 V. Must be the same as pin 16.
5
ACS1
TwoLevel Input
A Clock Select 1. Selects outputs on CLKA1 and CLKA2 per table on page 3. Internal
pullup.
6
GND
Power
Connect to ground.
7
CLKC1
Output
Output Clock C1. Depends on setting of CCS per table on page 3.
8
CLKC2
Output
Output Clock C2. Depends on setting of CCS per table on page 3. Same as CLKC1.
9
CLKB2
Output
Output Clock B2. Depends on setting of BCS1, 0 per table on page 3.
10
CLKB1
Output
Output Clock B1. Depends on setting of BCS1, 0 per table on page 3.
11
CCS
TriLevel Input
Clock C select pin. Selects outputs on CLKC1 and CLKC2 per table on page 3.
12
NC
No Connect
13
CLKA2
Output
Output Clock A2. Depends on setting of ACS1, 0 per table on page 3.
14
GND
Power
Connect to ground.
15
OE
Input
Output enable. Tristates all outputs when low. Internal pullup.
16
VDD
Power
Connect to +3.3 V. Must be the same as pin 4.
17
CLKA1
Output
Output Clock A1. Depends on setting of ACS1, 0 per table on page 3.
18
REFOUT
Output
Buffered reference clock output. Same frequency as crystal or clock input.
19
BCS0
TriLevel Input
B Clock Select 0. Selects outputs on CLKB1 and CLKB2 per table on page 3.
20
BCS1
TwoLevel Input
B Clock Select 1. Selects outputs on CLKB1 and CLKB2 per table on page 3. Internal
pullup.
1. All VDD and GND pins must be externally connected to a power supply for proper operation.
相關PDF資料 |
PDF描述 |
|---|---|
| NB3N853501EDTG | IC CLOCK BUFFER MUX 2:4 20-TSSOP |
| NB3N853531EDTG | IC FANOUT BUFFER LVPECL 20TSSOP |
| NB3RL02FCT2G | IC CLK BUFFER 1:2 52MHZ 8-WLCSP |
| NB4L16MMNR2 | IC CLK BUFFER DVR TRANSLA 16-QFN |
| NB4L6254MNG | IC CLK BUFFER MUX 1:6/1:3 32-QFN |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| NB3N65027DTGEVB | 功能描述:時鐘和定時器開發(fā)工具 NB3N65027 CUST EVAL BOARD RoHS:否 制造商:Texas Instruments 產品:Evaluation Modules 類型:Clock Conditioners 工具用于評估:LMK04100B 頻率:122.8 MHz 工作電源電壓:3.3 V |
| NB3N65027DTR2G | 功能描述:時鐘合成器/抖動清除器 NETWORKING SOURCE CLOCK RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel |
| NB3N853501EDTG | 功能描述:時鐘驅動器及分配 2:1:4 LVPECL FAN-OUT BUFF RoHS:否 制造商:Micrel 乘法/除法因子:1:4 輸出類型:Differential 最大輸出頻率:4.2 GHz 電源電壓-最大: 電源電壓-最小:5 V 最大工作溫度:+ 85 C 封裝 / 箱體:SOIC-8 封裝:Reel |
| NB3N853501EDTR2G | 功能描述:時鐘驅動器及分配 2:1:4 LVPECL FAN-OUT BUFF RoHS:否 制造商:Micrel 乘法/除法因子:1:4 輸出類型:Differential 最大輸出頻率:4.2 GHz 電源電壓-最大: 電源電壓-最小:5 V 最大工作溫度:+ 85 C 封裝 / 箱體:SOIC-8 封裝:Reel |
| NB3N853531EDTG | 功能描述:時鐘緩沖器 FAN-OUT BUFF W/CRYSL INPT RoHS:否 制造商:Texas Instruments 輸出端數(shù)量:5 最大輸入頻率:40 MHz 傳播延遲（最大值）: 電源電壓-最大:3.45 V 電源電壓-最小:2.375 V 最大功率耗散: 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:LLP-24 封裝:Reel |
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