參數(shù)資料
型號： MSC8144SVT800A
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 數(shù)字信號處理
英文描述： 133 MHz, OTHER DSP, PBGA783
封裝： 29 X 29 MM, LEAD FREE, PLASTIC, FCPBGA-783
文件頁數(shù)： 65/80頁
文件大?。?/td> 1250K
代理商： MSC8144SVT800A
MSC8144 Quad Core Digital Signal Processor Data Sheet, Rev. 16
Hardware Design Considerations
Freescale Semiconductor
68
3.4.1.2
16-Bit DDR Memory Only
Table 52 lists unused pin connection when using 16-bit DDR memory. The 16 most significant data lines are not used.
MDM[0–3]
NC
MBA[0–2]
NC
MCAS
NC
MCKE[0–1]
NC
MODT[0–1]
NC
MDIC[0–1]
NC
MRAS
NC
MWE
NC
MECC[0–7]
NC
ECC_MDM
NC
ECC_MDQS
NC
ECC_MDQS
NC
MVREF
GND
VDDDDR
GND
Note:
If the DDR controller is not used, disable the internal DDR clock by writing a 1 to the CLK11DIS bit in the System Clock Control
Register (SCCR[CLK!11DIS]). See Chapter 7, Clocks, in the MSC8144 Reference Manual for details.
Table 52. Connectivity of DDR Related Pins When Using 16-bit DDR Memory Only
Signal Name
Pin connection
MDQ[0–15]
in use
MDQ[16–31]
pull-up to VDDDDR
MDQS[0–1]
in use
MDQS[2–3]
pull-down to GND
MDQS[0–1]
in use
MDQS[2–3]
pull-up to VDDDDR
MA[0–15]
in use
MCK[0–2]
in use
MCK[0–2]
in use
MCS[0–1]
in use
MDM[0–1]
in use
MDM[2–3]
NC
MBA[0–2]
in use
MCAS
in use
MCKE[0–1]
in use
MODT[0–1]
in use
MDIC[0–1]
in use
MRAS
in use
Table 51. Connectivity of DDR Related Pins When the DDR Interface Is Not Used (continued)
Signal Name
Pin Connection
相關(guān)PDF資料
PDF描述
MSC8156SVT1000B 0-BIT, OTHER DSP, PBGA783
MSC8254TVT800B 0-BIT, OTHER DSP, PBGA783
MSC8254SVT800B 0-BIT, OTHER DSP, PBGA783
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參數(shù)描述
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