參數(shù)資料
型號(hào)： MSC8144SVT1000A
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 43/80頁(yè)
文件大?。?/td> 0K
描述： IC DSP QUAD 1GHZ 783FCPBGA
標(biāo)準(zhǔn)包裝： 1
系列： StarCore
類(lèi)型： SC3400 內(nèi)核
接口： 以太網(wǎng)，I²C，SPI，TDM，UART，UTOPIA
時(shí)鐘速率： 1.0GHz
非易失內(nèi)存： 外部
芯片上RAM： 10.5MB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.00V
工作溫度： 0°C ~ 105°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 783-BBGA，F(xiàn)CBGA
供應(yīng)商設(shè)備封裝： 783-FCPBGA（29x29）
包裝： 托盤(pán)
MSC8144 Quad Core Digital Signal Processor Data Sheet, Rev. 16
Electrical Characteristics
Freescale Semiconductor
48
Table 34. Receiver AC Timing Specifications—3.125 GBaud
Characteristic
Symbol
Range
Unit
Notes
Min
Max
Differential Input Voltage
VIN
200
1600
mVPP
Measured at receiver
Deterministic Jitter Tolerance
JD
0.37
UIPP
Measured at receiver
Combined Deterministic and Random
Jitter Tolerance
JDR
0.55
UIPP
Measured at receiver
Total Jitter Tolerance
JT
0.65
UIPP
Measured at receiver. Total jitter is composed of
three components, deterministic jitter, random jitter
and single frequency sinusoidal jitter. The sinusoidal
jitter may have any amplitude and frequency in the
unshaded region of Figure 13. The sinusoidal jitter
component is included to ensure margin for low
frequency jitter, wander, noise, crosstalk and other
variable system effects.
Multiple Input Skew
SMI
22
ns
Skew at the receiver input between lanes of a
multilane link
Bit Error Rate
BER
10–12
Unit Interval
UI
320
ps
±100 ppm
Figure 13. Single Frequency Sinusoidal Jitter Limits
8.5 UI p-p
0.10 UI p-p
Sinusoidal
Jitter
Amplitude
22.1 kHz
1.875 MHz
20 MHz
Frequency
相關(guān)PDF資料
PDF描述
KMC8113TVT4800V IC DSP 300/400MHZ 431FCPGA
ECS-H1DY684R CAP TANT 0.68UF 20V 20% 1206
TAJC107M010K CAP TANT 100UF 10V 20% 2312
GEC10DREN-S734 CONN EDGECARD 20POS .100 EYELET
KMC8113TVT3600V IC DSP 300/400MHZ 431FCPGA
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參數(shù)描述
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