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參數(shù)資料
| 型號(hào)： | MSC8122TMP6400 |
| 廠商： | 飛思卡爾半導(dǎo)體(中國(guó))有限公司 |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | Quad Core 16-Bit Digital Signal Processor |
| 中文描述： | 四核16位數(shù)字信號(hào)處理器 |
| 文件頁(yè)數(shù)： | 60/88頁(yè) |
| 文件大小： | 983K |
| 代理商： | MSC8122TMP6400 |
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MSC8122 Technical Data, Rev. 13
2-26
Freescale Semiconductor
Specifications
704
705
706
707
708
709
710
711
712
713
Note:
Boundary scan input data set-up time
Boundary scan input data hold time
TCK low to output data valid
TCK low to output high impedance
TMS, TDI data set-up time
TMS, TDI data hold time
TCK low to TDO data valid
TCK low to TDO high impedance
TRST assert time
TRST set-up time to TCK low
All timings apply to OnCE module data transfers as well as any other transfers via the JTAG port.
5.0
20.0
0.0
0.0
5.0
20.0
0.0
0.0
100.0
30.0
—
—
30.0
30.0
—
—
20.0
20.0
—
—
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
Figure 2-23.
Test Clock Input Timing Diagram
Figure 2-24.
Boundary Scan (JTAG) Timing Diagram
Table 2-29.
JTAG Timing (Continued)
No.
Characteristics
All
frequencies
Unit
Min
Max
TCK
(Input)
V
M
V
M
V
IH
V
IL
701
702
703
703
TCK
(Input)
Data
Inputs
Data
Outputs
Data
Outputs
V
IH
V
IL
Input Data Valid
Output Data Valid
705
704
706
707
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MSC8122TMP6400V | Quad Core 16-Bit Digital Signal Processor |
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參數(shù)描述 |
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