參數(shù)資料
型號: MSC7112VM800
廠商: Freescale Semiconductor
文件頁數(shù): 46/56頁
文件大小: 0K
描述: IC DSP PROCESSOR 16BIT 400MAPBGA
標準包裝: 90
系列: StarCore
類型: SC1400 內(nèi)核
接口: 主機接口,I²C,UART
時鐘速率: 200MHz
非易失內(nèi)存: 外部
芯片上RAM: 208kB
電壓 - 輸入/輸出: 3.30V
電壓 - 核心: 1.20V
工作溫度: -40°C ~ 105°C
安裝類型: 表面貼裝
封裝/外殼: 400-LFBGA
供應商設(shè)備封裝: 400-MAPBGA(17x17)
包裝: 托盤
MSC7112 Low-Cost 16-bit DSP with DDR Controller Data Sheet, Rev. 11
Hardware Design Considerations
Freescale Semiconductor
50
3.4.3.2
I2C Boot
When the MSC7112 device is configured to boot from the I2C port, the boot program configures the GPIO pins shared with the
I2C pins as I2C pins. The I2C interface is configured as follows:
I2C in master mode.
EPROM in slave mode.
For details on the boot procedure, see the “Boot Program” chapter of the MSC711x Reference Manual.
3.5
DDR Memory System Guidelines
MSC7112 devices contain a memory controller that provides a glueless interface to external double data rate (DDR) SDRAM
memory modules with Class 2 Series Stub Termination Logic 2.5 V (SSTL_2). There are two termination techniques, as shown
in Figure 32. Technique B is the most popular termination technique.
Figure 33 illustrates the power wattage for the resistors. Typical values for the resistors are as follows:
RS = 22
Ω
RT = 24
Ω
Figure 32. SSTL Termination Techniques
Controller
Address
Command
Chip Selects
Data
Strobes
Mask
VREF
VTT
T
e
rm
in
ator
VTT
Generator
DDR
Bank
DDR
Bank
VTT
SSTL_2
RS
RT
RS
Controller
Address
Command
Chip Selects
Data
Strobes
Mask
VT
T
e
rm
ina
tor
I
s
land
VTT
Generator
DDR
Bank
DDR
Bank
SSTL_2
RS
RT
RS
Technique A
Technique B
相關(guān)PDF資料
PDF描述
MSC7113VM800 IC DSP PROCESSOR 16BIT 400MAPBGA
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參數(shù)描述
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