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參數(shù)資料
| 型號(hào)： | MR80C52CXXX-36:R |
| 廠商： | TEMIC SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 36 MHz, MICROCONTROLLER, CQCC44 |
| 文件頁(yè)數(shù)： | 80/134頁(yè) |
| 文件大?。?/td> | 3805K |
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5
8068U–AVR–06/2013
XMEGA A3
Not recommended for new designs -
Use XMEGA A3U series
3.1
Block Diagram
Figure 3-1.
XMEGA A3 Block Diagram
PE[0..7]
PORT E (8)
TC
E0:1
U
S
AR
TE0:1
TWI
E
SP
IE
TCF0
USARTF0
POR
T
F
(8
)
Power
Supervision
POR/BOD &
RESET
PORT A (8)
PORT B (8)
DMA
Controller
BUS
Controller
SRAM
ADCA
ACA
DACB
ADCB
ACB
OCD
PDI
CPU
PA[0..7]
PB[0..7]/
JTAG
Watchdog
Timer
Watchdog
Oscillator
Interrupt
Controller
DATA BUS
Prog/Debug
Controller
VCC
GND
Oscillator
Circuits/
Clock
Generation
Oscillator
Control
Real Time
Counter
Event System
Controller
JTAG
PDI_DATA
RESET/
PDI_CLK
PORT B
Sleep
Controller
Flash
EEPROM
NVM Controller
DES
AES
IRCOM
PORT C (8)
PC[0..7]
TC
C0:1
U
S
AR
TC0:1
TWI
C
SP
IC
PD[0..7]
P
O
RT
R
(2
)
XTAL1
XTAL2
PR[0..1]
PORT D (8)
TC
D0:1
U
S
AR
TD0:1
SP
ID
TOSC1
TOSC2
EVENT ROUTING NETWORK
PF[0..7]
To Clock
Generato
r
Int. Ref.
AREFA
AREFB
Tempref
VCC/10
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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