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參數(shù)資料
| 型號： | MPC9449AER2 |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 10/11頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK BUFF DVDR MUX 3:15 52LQFP |
| 標準包裝： | 1,500 |
| 類型： | 扇出緩沖器（分配），除法器，多路復用器 |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 3:15 |
| 差分 - 輸入:輸出： | 是/無 |
| 輸入： | LVCMOS，LVPECL |
| 輸出： | LVCMOS |
| 頻率 - 最大： | 200MHz |
| 電源電壓： | 2.375 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 52-LQFP |
| 供應商設備封裝： | 52-TQFP（10x10） |
| 包裝： | 帶卷 (TR) |
MPC9449 REVISION 6 DECEMBER 21, 2012
8
2012 Integrated Device Technology, Inc.
MPC9449 Data Sheet
3.3V/2.5V 1:15 PECL/LVCMOS CLOCK FANOUT BUFFER
Figure 8. Output-to-Output Skew tSK(O)
Figure 9. Propagation Delay (tPD) Test Reference
Figure 10. Propagation Delay (tPD) Test Reference
Figure 11. Propagation Delay tSK(P) Test Reference
Figure 12. Output Transition Time Test Reference
Figure 13. Cycle-to-Cycle Jitter
Figure 14
The pin-to-pin skew is defined as the worst case difference in propagation delay be-
tween any similar delay path within a single device
VCC
VCC÷2
GND
VCC
VCC÷2
GND
tSK(O)
VCC
VCC÷2
GND
t(LH)
QX
CCLK
VCC
VPP
t(HL)
VCC÷2
GND
VCC
VCC÷2
GND
t(LH)
QX
PCLK
VPP
t(HL)
VCMR
PCLK
VCC
VCC÷2
GND
t(LH)
QX
CCLK
VCC
t(HL)
VCC÷2
GND
t(HL)
tSK(P)= tPLH–tPLH
tF
tR
VCC=3.3 V VCC=2.5 V
2.4
1.8 V
0.55
0.6 V
The variation in cycle time of a signal between adjacent cycles, over a ran-
dom sample of adjacent cycle pairs
TN
TJIT(CC) = |TN -TN+1|
TN+1
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