參數(shù)資料
型號： MPC8544CVTANGA
廠商： Freescale Semiconductor
文件頁數(shù)： 62/117頁
文件大?。?/td> 0K
描述： IC MPU POWERQUICC III 783-FCBGA
標準包裝： 36
系列： MPC85xx
處理器類型： 32-位 MPC85xx PowerQUICC III
速度： 800MHz
電壓： 0.95 V ~ 1.05 V
安裝類型： 表面貼裝
封裝/外殼： 783-BBGA，F(xiàn)CBGA
供應商設備封裝： 783-FCPBGA（29x29）
包裝： 托盤
MPC8544E PowerQUICC III Integrated Processor Hardware Specifications, Rev. 6
Freescale Semiconductor
49
Local Bus
Figure 28 through Figure 33 show the local bus signals.
Figure 28. Local Bus Signals (PLL Enabled)
Table 48 describes the general timing parameters of the local bus interface at VDD = 3.3 V DC with PLL
disabled.
Table 48. Local Bus General Timing Parameters—PLL Bypassed
Parameter
Symbol1
Min
Max
Unit
Notes
Local bus cycle time
tLBK
12
—
ns
2
Local bus duty cycle
tLBKH/tLBK
43
57
%
—
Internal launch/capture clock to LCLK delay
tLBKHKT
1.2
4.9
ns
—
Input setup to local bus clock (except LUPWAIT)
tLBIVKH1
7.4
—
ns
4, 5
LUPWAIT input setup to local bus clock
tLBIVKL2
6.75
—
ns
4, 5
Input hold from local bus clock (except LUPWAIT)
tLBIXKH1
–0.2
—
ns
4, 5
LUPWAIT input hold from local bus clock
tLBIXKL2
–0.2
—
ns
4, 5
LALE output transition to LAD/LDP output transition
(LATCH hold time)
tLBOTOT
1.5
—
ns
6
Local bus clock to output valid (except LAD/LDP and LALE)
tLBKLOV1
—
1.6
ns
—
Output Signals:
LA[27:31]/LBCTL/LBCKE/LOE/
LSDA10/LSDWE/LSDRAS/
LSDCAS/LSDDQM[0:3]
tLBKHOV1
tLBKHOV2
tLBKHOV3
LSYNC_IN
Input Signals:
LAD[0:31]/LDP[0:3]
Output (Data) Signals:
LAD[0:31]/LDP[0:3]
Output (Address) Signal:
LAD[0:31]
LALE
tLBIXKH1
tLBIVKH1
tLBIVKH2
tLBIXKH2
tLBKHOX1
tLBKHOZ1
tLBKHOX2
tLBKHOZ2
Input Signal:
LGTA
tLBOTOT
tLBKHOZ2
tLBKHOX2
tLBKHOV4
LUPWAIT
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PDF描述
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參數(shù)描述
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MPC8544DVTALFA 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC PQ38K 8544 RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT
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