參數(shù)資料
型號： MPC8535CVTANGA
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 800 MHz, MICROPROCESSOR, PBGA783
封裝： 29 X 29 MM, 2.80 MM HEIGHT, 1 MM PITCH, LEAD FREE, PLASTIC, FCBGA-783
文件頁數(shù)： 55/126頁
文件大?。?/td> 2861K
代理商： MPC8535CVTANGA
MPC8535E PowerQUICC III Integrated Processor Hardware Specifications, Rev. 3
DDR2 and DDR3 SDRAM
Freescale Semiconductor
34
2.6.2.2
DDR2 and DDR3 SDRAM Interface Output AC Timing Specifications
Table 19 contains the output AC timing targets for the DDR2 and DDR3 SDRAM interface.
Table 19. DDR SDRAM Output AC Timing Specifications
At recommended operating conditions with GVDD of 1.8 V ± 5% for DDR2 or 1.5 V ± 5% for DDR3.
Parameter
Symbol 1
Min
Max
Unit
Notes
MCK[n] cycle time, MCK[n]/MCK[n] crossing
tMCK
3.0
5
ns
2
ADDR/CMD output setup with respect to MCK
tDDKHAS
ns
3
667 MHz
1.10
—
7
533 MHz
1.48
—
400 MHz
1.95
—
ADDR/CMD output hold with respect to MCK
tDDKHAX
ns
3
667 MHz
1.10
—
7
533 MHz
1.48
—
400 MHz
1.95
—
MCS[n] output setup with respect to MCK
tDDKHCS
ns
3
667 MHz
1.10
—
7
533 MHz
1.48
—
400 MHz
1.95
—
MCS[n] output hold with respect to MCK
tDDKHCX
ns
3
667 MHz
1.10
—
7
533 MHz
1.48
—
400 MHz
1.95
—
MCK to MDQS Skew
tDDKHMH
ns
4
<= 667 MHz
–0.6
0.6
7
MDQ/MECC/MDM output setup with respect to
MDQS
tDDKHDS,
tDDKLDS
ps
5
667 MHz
450
—
7
533 MHz
538
—
400 MHz
700
—
MDQ/MECC/MDM output hold with respect to
MDQS
tDDKHDX,
tDDKLDX
ps
5
667 MHz
450
—
7
533 MHz
538
—
400 MHz
700
—
MDQS preamble start
tDDKHMP
ns
6
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