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參數(shù)資料
| 型號： | MPC8343CZQADDB |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 266 MHz, MICROPROCESSOR, PBGA620 |
| 封裝： | 29 X 29 MM, 2.46 MM HEIGHT, 1 MM PITCH, PLASTIC, BGA-620 |
| 文件頁數(shù)： | 43/79頁 |
| 文件大小： | 992K |
| 代理商： | MPC8343CZQADDB |
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MPC8343EA PowerQUICC II Pro Integrated Host Processor Hardware Specifications, Rev. 10
48
Freescale Semiconductor
Package and Pin Listings
Figure 33 and Figure 34 represent the AC timings from Table 50. Note that although the specifications
generally reference the rising edge of the clock, these AC timing diagrams also apply when the falling edge
is the active edge.
Figure 33 shows the SPI timings in slave mode (external clock).
Figure 33. SPI AC Timing in Slave Mode (External Clock) Diagram
Figure 34 shows the SPI timings in master mode (internal clock).
Figure 34. SPI AC Timing in Master Mode (Internal Clock) Diagram
18 Package and Pin Listings
This section details package parameters, pin assignments, and dimensions. The MPC8343EA is available
in a plastic ball grid array (PBGA). See Section 18.1, “Package Parameters for the MPC8343EA PBGA,”
18.1
Package Parameters for the MPC8343EA PBGA
The package parameters are as provided in the following list. The package type is 29 mm
× 29 mm,
620 plastic ball grid array (PBGA).
Package outline
29 mm
× 29 mm
Interconnects
620
Pitch
1.00 mm
Module height (maximum)
2.46 mm
SPICLK (Input)
tNEIXKH
tNEIVKH
tNEKHOX
Input Signals:
SPIMOSI
(See Note)
Output Signals:
SPIMISO
(See Note)
Note: The clock edge is selectable on SPI.
SPICLK (Output)
tNIIXKH
tNIKHOX
Input Signals:
SPIMISO
(See Note)
Output Signals:
SPIMOSI
(See Note)
Note: The clock edge is selectable on SPI.
tNIIVKH
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PDF描述 |
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參數(shù)描述 |
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| MPC8343ECVRAGD | 功能描述:IC MPU PWRQUICC II PRO 620-PBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:MPC83xx 標準包裝:1 系列:MPC85xx 處理器類型:32-位 MPC85xx PowerQUICC III 特點:- 速度:1.2GHz 電壓:1.1V 安裝類型:表面貼裝 封裝/外殼:783-BBGA，F(xiàn)CBGA 供應商設備封裝:783-FCPBGA（29x29） 包裝:托盤 |
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