Table 18. I2C TimingSCL < 100 kHz NUM CHARAC" />
參數(shù)資料
型號： MPC823CVR66B2T
廠商： Freescale Semiconductor
文件頁數(shù)： 59/70頁
文件大?。?/td> 0K
描述： IC MPU POWER QUICC I 256-PBGA
標準包裝： 60
系列： MPC8xx
處理器類型： 32-位 MPC8xx PowerQUICC
速度： 66MHz
電壓： 1.8V
安裝類型： 表面貼裝
封裝/外殼： 256-BGA
供應商設備封裝： 256-PBGA（23x23）
包裝： 托盤
配用： MPC823FADS-ND - KIT APPLICATION DEV 823 FAMILY
MPC823 ELECTRICAL SPECIFICATIONS
Table 18. I2C TimingSCL < 100 kHz
NUM
CHARACTERISTIC
25MHZ
40MHZ
50MHZ
UNIT
MIN
MAX
MIN
MAX
MIN
MAX
200
SCL clock frequency (slave)
0
100
0
100
0
100
kHz
200
SCL clock frequency (master)
1.5
100
1.5
100
1.5
100
kHz
202
Bus free time between transmissions
4.7
4.7
4.7
ms
203
Low period of SCL
4.7
4.7
4.7
ms
204
High period of SCL
4.0
4.0
4.0
ms
205
Start condition setup time
4.7
4.7
4.7
ms
206
Start condition hold time
4.0
4.0
4.0
ms
207
Data hold time
000
ms
208
Data setup time
250
250
250
ns
209
SDL/SCL rise time
111
ms
210
SDL/SCL fall time
300
300
300
ns
211
STOP condition setup time
4.7
4.7
4.7
ms
NOTE: SCL frequency is given by SCL = BRGCLK_frequency/((BRG register + 3) * pre_scaler * 2 ).
The ratio SyncClk/(BRGCLK/pre_scaler) must be greater than or equal to 4/1.
Table 19. I2C TimingSCL > 100 kHz
NUM
CHARACTERISTIC
MINIMUM
MAXIMUM
UNIT
200
SCL clock frequency (slave)
0
BRGCLK/48
Hz
200
SCL clock frequency (master)
BRGCLK/16512
BRGCLK/48
Hz
202
Bus free time between transmissions
1/(2.2 * fSCL)
sec
203
Low period of SCL
1/(2.2 * fSCL)
sec
204
High period of SCL
1/(2.2 * fSCL)
sec
205
Start condition setup time
1/(2.2 * fSCL)
sec
206
Start condition hold time
1/(2.2 * fSCL)
sec
207
Data hold time
0
sec
208
Data setup time
1/(40 * fSCL)
sec
209
SDL/SCL rise time
1/(10 * fSCL)
sec
210
SDL/SCL fall time
1/(33 * fSCL)
sec
211
Stop condition setup time
1/(2.2 * fSCL)
sec
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述
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參數(shù)描述
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