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參數(shù)資料
| 型號(hào)： | MPC5603PGF0VLL6 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, FLASH, 64 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 14 MM, 1.40 MM HEIGHT, 0.50 MM PITCH, ROHS COMPLIANT LQFP-100 |
| 文件頁(yè)數(shù)： | 62/82頁(yè) |
| 文件大?。?/td> | 1613K |
| 代理商： | MPC5603PGF0VLL6 |
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MPC5604P Microcontroller Data Sheet, Rev. 6.1
Freescale Semiconductor
65
3.16.4
External Interrupt Timing (IRQ pin)
Figure 27. External Interrupt Timing
3.16.5
DSPI Timing
Table 36. External Interrupt Timing1
1 IRQ timing specified at f
SYS = 64 MHz and VDD_HV_IOx = 3.0 V to 5.5 V, TA = TL to TH, and CL = 200pF with SRC = 0b00.
No.
Symbol
C
Parameter
Conditions
Min
Max Unit
1tIPWL
CC
D
IRQ pulse width low
—
4
—
tCYC
2tIPWH
CC
D
IRQ pulse width high
—
4
—
tCYC
3tICYC
CC
D
IRQ edge to edge time2
2 Applies when IRQ pins are configured for rising edge or falling edge events, but not both.
—4 + N 3
3 N= ISR time to clear the flag
—tCYC
Table 37. DSPI Timing1
No.
Symbol
C
Parameter
Conditions
Min
Max
Unit
1tSCK
CC
D
DSPI cycle time
Master (MTFE = 0)
60
—
ns
Slave (MTFE = 0)
60
—
2tCSC CC
D
CS to SCK delay
—
16
—
ns
3tASC CC
D
After SCK delay
—
26
—
ns
4tSDC CC
D
SCK duty cycle
—
0.4 * tSCK 0.6 * tSCK ns
5tA
CC
D
Slave access time
SS active to SOUT valid
—
30
ns
6tDIS
CC
D
Slave SOUT disable time
SS inactive to SOUT High-Z or invalid
—
16
ns
7tPCSC CC
D
PCSx to PCSS time
—
13
—
ns
8tPASC CC
D
PCSS to PCSx time
—
13
—
ns
IRQ
2
3
1
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