參數(shù)資料
型號： MMC2107PU
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： HCMOS Microcontroller Unit
中文描述： 32-BIT, FLASH, 33 MHz, RISC MICROCONTROLLER, PQFP100
封裝： 14 X 14 MM, 1.40 MM HEIGHT, 0.50 MM PITCH, LQFP-100
文件頁數(shù)： 26/618頁
文件大?。?/td> 7373K
代理商： MMC2107PU
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Technical Data
MMC2107 – Rev. 2.0
26
Table of Contents
MOTOROLA
Table of Contents
21.13 Signal Descriptions. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .555
21.13.1 Debug Serial Input (TDI) . . . . . . . . . . . . . . . . . . . . . . . . . .555
21.13.2 Debug Serial Clock (TCLK) . . . . . . . . . . . . . . . . . . . . . . . .555
21.13.3 Debug Serial Output (TDO) . . . . . . . . . . . . . . . . . . . . . . . .555
21.13.4 Debug Mode Select (TMS). . . . . . . . . . . . . . . . . . . . . . . . .556
21.13.5 Test Reset (TRST). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .556
21.13.6 Debug Event (DE) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .556
21.14 Functional Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .556
21.14.1 Operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .557
21.14.2 OnCE Controller and Serial Interface. . . . . . . . . . . . . . . . .558
21.14.3 OnCE Interface Signals . . . . . . . . . . . . . . . . . . . . . . . . . . .559
21.14.3.1
Internal Debug Request Input (IDR) . . . . . . . . . . . . . . .559
21.14.3.2
CPU Debug Request (DBGRQ). . . . . . . . . . . . . . . . . . .560
21.14.3.3
CPU Debug Acknowledge (DBGACK). . . . . . . . . . . . . .560
21.14.3.4
CPU Breakpoint Request (BRKRQ). . . . . . . . . . . . . . . .560
21.14.3.5
CPU Address, Attributes (ADDR, ATTR). . . . . . . . . . . .560
21.14.3.6
CPU Status (PSTAT) . . . . . . . . . . . . . . . . . . . . . . . . . . .560
21.14.3.7
OnCE Debug Output (DEBUG) . . . . . . . . . . . . . . . . . . .560
21.14.4 OnCE Controller Registers. . . . . . . . . . . . . . . . . . . . . . . . .561
21.14.4.1
OnCE Command Register . . . . . . . . . . . . . . . . . . . . . . .561
21.14.4.2
OnCE Control Register . . . . . . . . . . . . . . . . . . . . . . . . .564
21.14.4.3
OnCE Status Register . . . . . . . . . . . . . . . . . . . . . . . . . .568
21.14.5 OnCE Decoder (ODEC). . . . . . . . . . . . . . . . . . . . . . . . . . .570
21.14.6 Memory Breakpoint Logic. . . . . . . . . . . . . . . . . . . . . . . . . .570
21.14.6.1
Memory Address Latch (MAL) . . . . . . . . . . . . . . . . . . . .571
21.14.6.2
Breakpoint Address Base Registers . . . . . . . . . . . . . . .571
21.14.7 Breakpoint Address Mask Registers . . . . . . . . . . . . . . . . .571
21.14.7.1
Breakpoint Address Comparators . . . . . . . . . . . . . . . . .572
21.14.7.2
Memory Breakpoint Counters . . . . . . . . . . . . . . . . . . . .572
21.14.8 OnCE Trace Logic . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .572
21.14.8.1
OnCE Trace Counter . . . . . . . . . . . . . . . . . . . . . . . . . . .573
21.14.8.2
Trace Operation. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .574
21.14.9 Methods of Entering Debug Mode . . . . . . . . . . . . . . . . . . .574
21.14.9.1
Debug Request During RESET . . . . . . . . . . . . . . . . . . .574
21.14.9.2
Debug Request During Normal Activity . . . . . . . . . . . . .575
21.14.9.3
Debug Request During Stop, Doze, or Wait Mode . . . .575
21.14.9.4
Software Request During Normal Activity . . . . . . . . . . .575
F
Freescale Semiconductor, Inc.
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Go to: www.freescale.com
n
.
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PDF描述
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