參數(shù)資料
型號： MMC2107CFCPV33
廠商： Freescale Semiconductor
文件頁數(shù)： 549/618頁
文件大?。?/td> 0K
描述： IC MCU 33MHZ 128K FLASH 144-LQFP
標(biāo)準(zhǔn)包裝： 60
系列： MCore
核心處理器： M210
芯體尺寸： 32-位
速度： 33MHz
連通性： EBI/EMI，SCI，SPI
外圍設(shè)備： POR，PWM，WDT
輸入/輸出數(shù)： 72
程序存儲器容量： 128KB（128K x 8）
程序存儲器類型： 閃存
RAM 容量： 8K x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 144-LQFP
包裝： 托盤
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Electrical Specifications
QADC Electrical Characteristics
MMC2107 – Rev. 2.0
Technical Data
MOTOROLA
Electrical Specifications
593
Table 22-8. QADC Conversion Specifications
(VDDH and VDDA = 5.0 Vdc ± 0.5 V, VDD = 2.7 to 3.6 V, VSS = VSSA = 0 Vdc,
VRH – VRL = 5 V ± 0.5 V, TA = TL to TH)
No.
Parameter
Symbol
Min
Max
Unit
1
QADC clock (QCLK) frequency(1)
fQCLK
0.5
2.1
MHz
2
Conversion cycles
CC
14
28
QCLK
cycles
3
Conversion time, fQCLK = 2.0 MHz
Minimum = CCW/IST =%00
Maximum = CCW/IST =%11
tCONV
7.0
14.0
s
4
Stop mode recovery time
tSR
—
10
s
5
Resolution(2)
—
5
—
mV
6
Absolute (total unadjusted) error(3), (4), (5)
fQCLK = 2.0 MHz
(2), two clock input sample time
AE
–22
Counts
7
Disruptive input injection current(6), (7), (8)
IINJ
(9)
–11
mA
8
Current coupling ratio(10)
PQA
PQB
K
—
8x10 –5
m
9
Incremental error due to injection current
All channels have same 10 k
< R
S <100 k
Channel under test has RS = 10 k,
IINJ = IINJMAX, IINJMIN
EINJ
—
+1.0
Counts
10
Source impedance at input(11)
RS
—
100
k
11
Incremental capacitance during sampling(12)
CSAMP
—
5pF
1. Conversion characteristics vary with fQCLK rate. Reduced conversion accuracy occurs at max fQCLK rate. Using the QADC
pins as GPIO functions during conversions may result in degraded results.
2. At VRH – VRL = 5.12 V, one count = 5 mV
3. Accuracy tested and guaranteed at VRH – VRL = 5.0 V ± 0.5 V
4. Absolute error includes 1/2 count (~2.5 mV) of inherent quantization error and circuit (differential, integral, and offset) error.
Specification assumes that adequate low-pass filtering is present on analog input pins — capacitive filter with 0.01
F to
0.1
F capacitor between analog input and analog ground, typical source isolation impedance of 10 k.
5. Input signals with large slew rates or high frequency noise components cannot be converted accurately. These signals may
affect the conversion accuracy of other channels
6. Below disruptive current conditions, the channel being stressed has conversion values of $3FF for analog inputs greater
than VRH and $000 for values less than VRL. This assumes that VRH < VDDA and VRL > VSSA due to the presence of the
sample amplifier. Other channels are not affected by non-disruptive conditions.
7. Exceeding limit may cause conversion error on stressed channels and on unstressed channels. Transitions within the limit
do not affect device reliability or cause permanent damage.
8. Input must be current limited to the value specified. To determine the value of the required current-limiting resistor, calculate
resistance values using VPOSCLAMP = VDDA + 0.5 V and VNEGCLAMP = – 0.3 V, then use the larger of the calculated values.
9. Condition applies to two adjacent pins.
10. Current coupling ratio, K, is defined as the ratio of the output current, IOut, measured on the pin under test to the injection
current, IINJ, when both adjacent pins are overstressed with the specified injection current. K = IOut/ IINJ The input voltage
error on the channel under test is calculated as VERR = IINJ x K x RS.
— Continued —
F
re
e
sc
a
le
S
e
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ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
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.
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PDF描述
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