FIGURE 23" />
參數(shù)資料
型號(hào)： XR16M780IM48-F
廠商： Exar Corporation
文件頁(yè)數(shù)： 47/58頁(yè)
文件大?。?/td> 0K
描述： IC UART FIFO 64B 48TQFP
標(biāo)準(zhǔn)包裝： 250
特點(diǎn)： *
通道數(shù)： 1，UART
FIFO's： 64 字節(jié)
規(guī)程： RS232，RS422，RS485
電源電壓： 1.62 V ~ 3.63 V
帶自動(dòng)流量控制功能： 是
帶IrDA 編碼器/解碼器： 是
帶故障啟動(dòng)位檢測(cè)功能： 是
帶調(diào)制解調(diào)器控制功能： 是
帶CMOS： 是
安裝類型： 表面貼裝
封裝/外殼： 48-TQFP
供應(yīng)商設(shè)備封裝： 48-TQFP（7x7）
包裝： 托盤
XR16M780
51
REV. 1.0.0
1.62V TO 3.63V HIGH PERFORMANCE UART WITH 64-BYTE FIFO
FIGURE 23. TRANSMIT READY & INTERRUPT TIMING [NON-FIFO MODE]
FIGURE 24. RECEIVE READY & INTERRUPT TIMING [FIFO MODE]
TX
TXRDY#
IOW#
INT*
D0:D7
Start
Bit
D0:D7
Stop
Bit
D0:D7
T
WT
TXNonFIFO
T
WT
T
WT
T
WRI
T
WRI
T
WRI
T
SRT
T
SRT
T
SRT
*INT is cleared when the ISR is read or when data is loaded into the THR.
ISR is read
(Loading data
into THR)
(Unloading)
IER[1]
enabled
RX
RXRDY#
IOR#
INT
D0:D7
S
T
SSR
RXINTDMA#
RX FIFO fills up to RX
Trigger Level or RX Data
Timeout
RX FIFO drops
below RX
Trigger Level
FIFO
Empties
First Byte is
Received in
RX FIFO
D0:D7
S
D0:D7
T
D0:D7
S
D0:D7
S
T
D0:D7
S
T
D0:D7
S
T
Start
Bit
Stop
Bit
T
RR
T
RRI
T
SSI
(Reading data out
of RX FIFO)
相關(guān)PDF資料
PDF描述
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XR16V2551IL-F IC UART FIFO 16B DUAL 32QFN
XR16V2552IJ-F IC UART FIFO 16B DUAL 44PLCC
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參數(shù)描述
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XR16M781IB25 制造商:EXAR 制造商全稱:EXAR 功能描述:1.62V TO 3.63V UART WITH 64-BYTE FIFO AND VLIO INTERFACE
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XR16M781IL24 制造商:EXAR 制造商全稱:EXAR 功能描述:1.62V TO 3.63V UART WITH 64-BYTE FIFO AND VLIO INTERFACE
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