- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄45333 > ML9044-51BCVWA (OKI ELECTRIC INDUSTRY CO LTD) 17 X 120 DOTS DOT MAT LCD DRVR AND DSPL CTLR, UUC175 PDF資料下載
參數(shù)資料
| 型號： | ML9044-51BCVWA |
| 廠商： | OKI ELECTRIC INDUSTRY CO LTD |
| 元件分類： | 顯示控制器 |
| 英文描述： | 17 X 120 DOTS DOT MAT LCD DRVR AND DSPL CTLR, UUC175 |
| 封裝： | 10.62 X 2.55 MM, GOLD BUMP, DIE-175 |
| 文件頁數(shù)： | 7/60頁 |
| 文件大小： | 579K |
| 代理商： | ML9044-51BCVWA |
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PEDL9044-03
1Semiconductor
ML9044-xxA/xxB
15/60
Address Counter (ADC)
The address counter provides a read/write address for the DDRAM, ABRAM or CGRAM and also provides a
cursor display address.
When an instruction code specifying DDRAM, ABRAM or CGRAM address setting is input to the pre-defined
register, the register selects the specified DDRAM, ABRAM or CGRAM and transfers the address code to the
ADC. The address data in the ADC is automatically incremented (or decremented) by 1 after the display data is
written in or read from the DDRAM, ABRAM or CGRAM.
The data in the ADC is output to DB
0 to DB6 when R/W = “H”, RS0 = “L”, RS1 = “H” and BF = “0”.
Timing Generator
The timing generator generates timing signals for the internal operation of the ML9044 activated by the instruction
sent from the CPU or for the operation of the internal circuits of the ML9041 such as DDRAM, ABRAM,
CGRAM and CGROM. Timing signals are generated so that the internal operation carried out for LCD displaying
will not be interfered by the internal operation initiated by accessing from the CPU. For example, when the CPU
writes data in the DDRAM, the display of the LCD not corresponding to the written data is not affected.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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