參數資料
型號： MK30DN512ZVLL10
元件分類： 微控制器/微處理器
英文描述： MICROCONTROLLER, PQFP64
封裝： 12 X 12 MM, 1.70 MM HEIGHT, 0.65 MM PITCH, PLASTIC, LQFP-64
文件頁數： 48/84頁
文件大小： 3949K
代理商： MK30DN512ZVLL10
MB95410H/470H Series
52
DS702-00004-1v0-E
4.
AC Characteristics
(1) Clock Timing
(VCC = 2.4 V to 5.5 V, VSS = 0.0 V, TA =
40°C to +85°C)
*: The external clock signal is input to X0 and the inverted external clock signal to X1.
Parameter Symbol Pin name Condition
Value
Unit
Remarks
Min
Typ
Max
Clock
frequency
FCH
X0, X1
—
1
—
16.25
MHz
When the main oscillation
circuit is used
X0
X1: open
1
—
12
MHz When the main external
clock is used
X0, X1
*1
—
32.5
MHz
—
3
—
8.13
MHz Main PLL multiplied by 2
—
3
—
6.5
MHz Main PLL multiplied by 2.5
—
3
—
4.06
MHz Main PLL multiplied by 4
FCRH
——
12.25
12.5
12.75
MHz
Operating conditions:
The main CR clock is used.
TA =
10°C to +85°C
9.8
10
10.2
MHz
7.84
8
8.16
MHz
0.98
1
1.02
MHz
——
12.1875
12.5
12.8125 MHz
Operating conditions:
The main CR clock is used.
TA =
40°C to 10°C
9.75
10
10.25
MHz
7.888.2
MHz
0.975
1
1.025
MHz
FCL
X0A, X1A
—
32.768
—
kHz
When the sub-oscillation
circuit is used
—
32.768
—
kHz
When the sub-external clock
is used
FCRL
—
50
100
200
kHz
When the sub-CR clock is
used
Clock cycle
time
tHCYL
X0, X1
—
61.5
—
1000
ns
When the main oscillation
circuit is used
X0
X1: open
83.4
—
1000
ns
When the external clock is
used
X0, X1
*
30.8
—
1000
ns
tLCYL
X0A, X1A
—
30.5
—
s
When the subclock is used
Input clock
pulse width
tWH1
tWL1
X0
X1: open
33.4
—
ns
When the external clock is
used, the duty ratio should
range between 40% and
60%.
X0, X1
*
12.4
—
ns
tWH2
tWL2
X0A
—
15.2
—
s
Input clock
rise time
and fall time
tCR
tCF
X0
X1: open
—
5
ns
When the external clock is
used
X0, X1
*
—
5
ns
CR
oscillation
start time
tCRHWK
——
—
80
s
When the main CR clock is
used
tCRLWK
——
—
10
s
When the sub-CR clock is
used
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