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參數(shù)資料
| 型號： | MK2745-21S |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 時鐘產(chǎn)生/分配 |
| 英文描述： | 80 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO16 |
| 封裝： | 0.150 INCH, SOIC-16 |
| 文件頁數(shù)： | 2/6頁 |
| 文件大?。?/td> | 184K |
| 代理商： | MK2745-21S |
MK2745-21
DVD/MPEG CLOCK SOURCE
VCXO AND SYNTHESIZER
IDT / ICS DVD/MPEG CLOCK SOURCE
2
MK2745-21
REV D 042904
Pin Assignment
Audio Clock (MHz) DecodingTable
Processor Clock (MHz)
0 = connect directly to ground
1 = connect directly to VDD
Pin Descriptions
1
2
3
GND
4
X2
5
6
24.576M
7
8
PCLK/2
VDD
27M
PCLK
PS0
ACLK
AS0
X1/ICLK
16
PS1
VDD
AS2
GND
AS1
15
14
13
12
11
10
9
16-pin (150 mil) SOIC
AS2 AS1 AS0
ACLK
0
12.288
0
1
11.2896
01
0
8.192
0
1
24.576
10
0
8.192
1
0
1
16.9344
1
0
18.432
1
11.2896
PS1
PS0
PCLK
PCLK/2
0
66.66
33.33
01
80
40
10
50
25
11
60
30
Pin
Number
Pin
Name
Pin
Type
Pin Description
1
PS1
Input
Processor clock Select 1. Selects processor clock outputs per table above.
2
X2
XO
Crystal connection. Connect to 27 MHz crystal. Leave unconnected for clock
input.
3
X1/ICLK
XI
Crystal connection. Connect to 27 MHz crystal or to a 27 MHz input clock.
4
VDD
Power
Connect to +3.3 V or +5 V. Must be same as other VDD.
5
GND
Power
Connect to ground.
6
ACLK
Output
Audio Clock output. Determined by status of AS2, AS1, AS0. See table above.
7
PCLK
Output
Processor Clock output. Determined by status of PS1, PS0. See table above.
8
AS2
Input
Audio clock Select 2. Selects audio clock on pin 6 per table above.
9
AS0
Input
Audio clock Select 0. Selects audio clock on pin 6 per table above.
10
27M
Output
27 MHz clock output.
11
GND
Power
Connect to ground.
12
AS1
Input
Audio clock Select 1. Selects audio clock on pin 6 per table above.
13
VDD
Power
Connect to +3.3 V or +5 V. Must be same as other VDD.
相關(guān)PDF資料 |
PDF描述 |
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| MK2761ASTR | 27 MHz, OTHER CLOCK GENERATOR, PDSO16 |
| MK2761ASLF | 27 MHz, OTHER CLOCK GENERATOR, PDSO16 |
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參數(shù)描述 |
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